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841N254AKIT

更新时间： 2024-01-16 18:34:49

品牌	Logo	应用领域
艾迪悌 - IDT		时钟
页数	文件大小	规格书
23页	480K
描述
FEMTOCLOCK? NG Crystal-to-LVDS/HCSL Clock Synthesizer

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841N254AKIT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	VFQFPN
包装说明：	HVQCCN,	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.33
Samacsys Confidence：	3	Samacsys Status：	Released
2D Presentation：	https://componentsearchengine.com/2D/0T/1912205.2.1.png	Schematic Symbol：	https://componentsearchengine.com/symbol.php?partID=1912205
PCB Footprint：	https://componentsearchengine.com/footprint.php?partID=1912205	3D View：	https://componentsearchengine.com/viewer/3D.php?partID=1912205
Samacsys PartID：	1912205	Samacsys Image：	https://componentsearchengine.com/Images/9/841N254BKILFT.jpg
Samacsys Thumbnail Image：	https://componentsearchengine.com/Thumbnails/2/841N254BKILFT.jpg	Samacsys Pin Count：	33
Samacsys Part Category：	Integrated Circuit	Samacsys Package Category：	Quad Flat No-Lead
Samacsys Footprint Name：	NLG32P1	Samacsys Released Date：	2020-01-19 15:35:53
Is Samacsys：	N	其他特性：	ALSO OPERATES AT 3.3 V SUPPLY
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	湿度敏感等级：	3
端子数量：	32	最高工作温度：	85 °C
最低工作温度：	-40 °C	最大输出时钟频率：	250 MHz
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	主时钟/晶体标称频率：	25 MHz
座面最大高度：	1 mm	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

841N254AKIT 数据手册

ICS841N254I Data Sheet

FEMTOCLOCK® NG CRYSTAL-TO-LVDS/HCSL CLOCK SYNTHESIZER

Function Tables

Table 3A. Output Divider and Output Frequency

Inputs

F_SEL1

F_SEL0

Operation

f_OUTwith f_REF= 25MHz

0 (default)

f_OUT= f_REF* 25 ÷ 4

156.25MHz

125MHz

100MHz

250MHz

_OUT= f_REF* 5

_OUT= f_REF* 4

f_OUT= f_REF* 10

NOTE: F_SEL[1:0] are asynchronous controls.

Table 3B. PLL Reference Clock Select Function Table

Input

REF_SEL

0 (default)

Operation

The crystal interface is selected as reference clock

The REF_CLK input is selected as reference clock

NOTE: REF_SEL is an asynchronous control.

Table 3C. PLL BYPASS Function Table

Input

BYPASS

Operation

PLL is enabled. The reference frequency f_REFis multiplied by the PLL

feedback divider of 25 and then divided by the selected output divider N.

0 (default)

PLL is bypassed. The reference frequency f_REFis divided by the selected

output divider N. AC specifications do not apply in PLL bypass mode.

NOTE: BYPASS is an asynchronous control.

Table 3D. nOEA Output Enable Function Table

Input

nOEA

0 (default)

Operation

QA0, nQA0 and QA1, nQA1 outputs are enabled

QA0, nQA0 and QA1, nQA1 outputs are disabled (high-impedance)

NOTE: nOEA is an asynchronous control.

Table 3E. nOEB Output Enable Function Table

Input

nOEB

0 (default)

Operation

QB0, nQB0 and QB1, nQB1 outputs are enabled

QB0, nQB0 and QB1, nQB1 outputs are disabled (high-impedance)

NOTE: nOEB is an asynchronous control.

ICS841N254AKI REVISION A APRIL 18, 2011

1 234 5 6 7...23

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