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7LVC841APWDH-T

更新时间： 2024-01-03 16:06:19

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恩智浦 - NXP		总线驱动器总线收发器锁存器逻辑集成电路光电二极管
页数	文件大小	规格书
10页	105K
描述
IC LVC/LCX/Z SERIES, 10-BIT DRIVER, TRUE OUTPUT, PDSO24, Bus Driver/Transceiver

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7LVC841APWDH-T 技术参数

生命周期：	Obsolete	包装说明：	TSSOP,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.45	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G24	长度：	7.8 mm
逻辑集成电路类型：	BUS DRIVER	位数：	10
功能数量：	1	端口数量：	2
端子数量：	24	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	传播延迟（tpd）：	8.6 ns
认证状态：	Not Qualified	座面最大高度：	1.1 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	宽度：	4.4 mm
Base Number Matches：	1

7LVC841APWDH-T 数据手册

Philips Semiconductors

Product specification

10-bit transparent latch with 5-volt tolerant

inputs/outputs (3-State)

74LVC841A

LOGIC SYMBOL (IEEE/IEC)

LOGIC SYMBOL

SV01724

SV01725

LOGIC DIAGRAM

LATCH

LE LE

SV01726

FUNCTION TABLE for register A or B

INPUTS

OUTPUTS

INTERNAL

LATCHES

OPERATING MODES

Q TO Q

Enable and read register (transparent mode)

Latch and read register

↓

latch register and disable outputs

Hold

NOTES:

HIGH voltage level

HIGH voltage level one set-up time prior to the HIGH-to-LOW LE transition

LOW voltage level

LOW voltage level one set-up time prior to the HIGH-to-LOW LE transition

don’t care

high impedance OFF-state

NC = no change

1998 Jun 17

1 234 5 6 7...10

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型号	品牌	描述	获取价格	数据表
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