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74LVC3G17GT

更新时间： 2024-10-01 11:10:39
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安世 - NEXPERIA 光电二极管逻辑集成电路
页数 文件大小 规格书
17页 273K
描述
Triple non-inverting Schmitt trigger with 5 V tolerant inputProduction

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74LVC3G17GT 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：VSON,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.57
Is Samacsys：N系列：LVC/LCX/Z
JESD-30 代码：R-PDSO-N8JESD-609代码：e3
长度：1.95 mm逻辑集成电路类型：BUFFER
湿度敏感等级：1功能数量：3
输入次数：1端子数量：8
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：VSON
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, VERY THIN PROFILE
峰值回流温度（摄氏度）：260传播延迟（tpd）：13.1 ns
座面最大高度：0.5 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：1.65 V标称供电电压 (Vsup)：1.8 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：1 mmBase Number Matches：1

74LVC3G17GT 数据手册

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74LVC3G17  
Triple non-inverting Schmitt trigger with 5 V tolerant input  
Rev. 14 — 26 August 2021  
Product data sheet  
1. General description  
The 74LVC3G17 is a triple buffer with Schmitt-trigger inputs. Inputs can be driven from either 3.3 V  
or 5 V devices. This feature allows the use of these devices as translators in mixed 3.3 V and 5 V  
environments.  
This device is fully specified for partial power down applications using IOFF. The IOFF circuitry  
disables the output, preventing the potentially damaging backflow current through the device when  
it is powered down.  
2. Features and benefits  
•
Wide supply voltage range from 1.65 V to 5.5 V  
•
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•
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•
•
•
Overvoltage tolerant inputs to 5.5 V  
High noise immunity  
±24 mA output drive (VCC = 3.0 V)  
CMOS low-power consumption  
Latch-up performance exceeds 250 mA  
Direct interface with TTL levels  
IOFF circuitry provides partial Power-down mode operation  
Complies with JEDEC standards  
•
•
•
•
JESD8-7 (1.65 V to 1.95 V)  
JESD8-5 (2.3 V to 2.7 V)  
JESD8C (2.7 V to 3.6 V)  
JESD36 (4.5 V to 5.5 V)  
•
ESD protection:  
•
•
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
•
•
Multiple package options  
Specified from -40 °C to +85 °C and -40 °C to +125 °C  
3. Applications  
•
Wave and pulse shapers for highly noisy environments  
 
 
 
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与74LVC3G17GT相关器件

型号 品牌 获取价格 描述 数据表
74LVC3G17GT,115 NXP

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 		74LVC3G17 - Triple non-inverting Schmitt trigger with 5 V tolerant input SON 8-Pin
74LVC3G17GT-G NXP

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 		Triple non-inverting Schmitt trigger with 5 V tolerant input
74LVC3G17-Q100 NEXPERIA

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 		Triple non-inverting Schmitt trigger with 5 V tolerant input
74LVC3G34 NXP

获取价格

 		Triple buffer gate
74LVC3G34 DIODES

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 		Triple gate 1 Input Buffer
74LVC3G34_08 NXP

获取价格

 		Triple buffer
74LVC3G34DC NXP

获取价格

 		Triple buffer gate
74LVC3G34DC NEXPERIA

获取价格

 		Triple bufferProduction
74LVC3G34DC,125 NXP

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 		74LVC3G34 - Triple buffer SSOP 8-Pin
74LVC3G34DC-Q100 NEXPERIA

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 		Triple buffer

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