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74HCT74PW-Q100

更新时间： 2024-09-28 01:10:47
品牌 Logo 应用领域
安世 - NEXPERIA 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
19页 798K
描述
Dual D-type flip-flop with set and reset; positive edge-trigger

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74HCT74PW-Q100 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：TSSOP-14Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.68
系列：HCTJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：5 mm
逻辑集成电路类型：D FLIP-FLOP湿度敏感等级：1
位数：1功能数量：2
端子数量：14最高工作温度：125 °C
最低工作温度：-40 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED传播延迟（tpd）：53 ns
筛选级别：AEC-Q100座面最大高度：1.1 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：Nickel/Palladium/Gold/Silver (Ni/Pd/Au/Ag)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：4.4 mm最小 fmax：18 MHz

74HCT74PW-Q100 数据手册

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74HC74-Q100; 74HCT74-Q100  
Dual D-type flip-flop with set and reset; positive edge-trigger  
Rev. 3 — 4 December 2015  
Product data sheet  
1. General description  
The 74HC74-Q100; 74HCT74-Q100 are dual positive edge triggered D-type flip-flop with  
individual data (nD), clock (nCP), set (nSD) and reset (nRD) inputs, and complementary  
nQ and nQ outputs. Data at the nD-input, that meets the set-up and hold time  
requirements on the LOW-to-HIGH clock transition, will be stored in the flip-flop and  
appear at the nQ output. The Schmitt-trigger action in the clock input, makes the circuit  
highly tolerant to slower clock rise and fall times. Inputs include clamp diodes. This  
enables the use of current limiting resistors to interface inputs to voltages in excess of  
VCC  
.
This product has been qualified to the Automotive Electronics Council (AEC) standard  
Q100 (Grade 1) and is suitable for use in automotive applications.  
2. Features and benefits  
Automotive product qualification in accordance with AEC-Q100 (Grade 1)  
Specified from 40 C to +85 C and from 40 C to +125 C  
Input levels:  
For 74HC74-Q100: CMOS level  
For 74HCT74-Q100: TTL level  
Symmetrical output impedance  
Low power dissipation  
High noise immunity  
Balanced propagation delays  
Specified in compliance with JEDEC standard no. 7A  
ESD protection:  
MIL-STD-883, method 3015 exceeds 2000 V  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0 )  
Multiple package options  
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