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74HCT4020DB-T

更新时间: 2024-01-30 12:01:19
品牌 Logo 应用领域
恩智浦 - NXP 光电二极管
页数 文件大小 规格书
7页 45K
描述
IC HCT SERIES, ASYN NEGATIVE EDGE TRIGGERED 14-BIT UP BINARY COUNTER, PDSO16, 5.30 MM, PLASTIC, MO-150, SOT338-1, SSOP-16, Counter

74HCT4020DB-T 技术参数

Source Url Status Check Date:2013-06-14 00:00:00是否Rohs认证: 符合
生命周期:Transferred零件包装代码:SSOP
包装说明:SSOP,针数:16
Reach Compliance Code:unknownHTS代码:8542.39.00.01
风险等级:5.1其他特性:OUTPUTS FROM 12 STAGES AVAILABLE
计数方向:UP系列:HCT
JESD-30 代码:R-PDSO-G16JESD-609代码:e4
长度:6.2 mm负载电容(CL):50 pF
负载/预设输入:YES逻辑集成电路类型:BINARY COUNTER
工作模式:ASYNCHRONOUS湿度敏感等级:1
位数:14功能数量:1
端子数量:16最高工作温度:125 °C
最低工作温度:-40 °C封装主体材料:PLASTIC/EPOXY
封装代码:SSOP封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, SHRINK PITCH峰值回流温度(摄氏度):260
传播延迟(tpd):54 ns认证状态:Not Qualified
座面最大高度:2 mm最大供电电压 (Vsup):5.5 V
最小供电电压 (Vsup):4.5 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:CMOS
温度等级:AUTOMOTIVE端子面层:NICKEL PALLADIUM GOLD
端子形式:GULL WING端子节距:0.65 mm
端子位置:DUAL处于峰值回流温度下的最长时间:30
触发器类型:NEGATIVE EDGE宽度:5.3 mm
最小 fmax:17 MHzBase Number Matches:1

74HCT4020DB-T 数据手册

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Philips Semiconductors  
Product specification  
14-stage binary ripple counter  
74HC/HCT4020  
DC CHARACTERISTICS FOR 74HC  
For the DC characteristics see “74HC/HCT/HCU/HCMOS Logic Family Specifications”.  
Output capability: standard  
ICC category: MSI  
AC CHARACTERISTICS FOR 74HC  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF  
Tamb (°C)  
TEST CONDITIONS  
74HC  
SYMBOL  
PARAMETER  
UNIT  
WAVEFORMS  
VCC  
(V)  
+25  
40 to +85 40 to +125  
min. typ. max. min. max. min. max.  
tPHL/ tPLH propagation delay  
CP to Q0  
39  
14  
11  
140  
28  
24  
175  
35  
30  
210  
42  
36  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
2.0 Fig.7  
4.5  
6.0  
t
PHL/ tPLH propagation delay  
Qn to Qn+1  
22  
8
6
75  
15  
13  
95  
19  
16  
110  
22  
19  
2.0 Fig.7  
4.5  
6.0  
tPHL  
propagation delay  
MR to Qn  
55  
20  
16  
170  
34  
29  
215  
43  
37  
225  
51  
43  
2.0 Fig.8  
4.5  
6.0  
t
THL/ tTLH output transition time  
19  
7
6
75  
15  
13  
95  
19  
16  
110  
22  
19  
2.0 Fig.7  
4.5  
6.0  
tW  
clock pulse width  
HIGH or LOW  
80  
16  
14  
11  
4
3
100  
20  
17  
120  
24  
20  
2.0 Fig.7  
4.5  
6.0  
tW  
master reset pulse width 80  
17  
6
5
100  
20  
17  
120  
24  
20  
2.0 Fig.8  
4.5  
6.0  
HIGH  
16  
14  
trem  
removal time  
MR to CP  
50  
10  
9
6
2
2
65  
13  
11  
75  
15  
13  
2.0 Fig.8  
4.5  
6.0  
fmax  
maximum clock pulse  
frequency  
6.0  
30  
35  
30  
92  
109  
4.8  
24  
28  
4.0  
20  
24  
MHz 2.0 Fig.7  
4.5  
6.0  
September 1993  
5

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