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74HCT165D/T3

更新时间： 2024-02-09 16:46:16

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恩智浦 - NXP		光电二极管输出元件逻辑集成电路触发器
页数	文件大小	规格书
22页	131K
描述
IC HCT SERIES, 8-BIT RIGHT PARALLEL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY OUTPUT, PDSO16, MINI, PLASTIC, SO-16, Shift Register

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74HCT165D/T3 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	MINI, PLASTIC, SO-16	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.21	其他特性：	CLOCK INHIBIT
计数方向：	RIGHT	系列：	HCT
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e4
长度：	5 mm	逻辑集成电路类型：	PARALLEL IN SERIAL OUT
湿度敏感等级：	1	位数：	8
功能数量：	1	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	51 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	NICKEL PALLADIUM GOLD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
触发器类型：	POSITIVE EDGE	宽度：	4.4 mm
最小 fmax：	17 MHz	Base Number Matches：	1

74HCT165D/T3 数据手册

74HC165; 74HCT165

8-bit parallel-in/serial out shift register

Rev. 03 — 14 March 2008

Product data sheet

1. General description

The 74HC165; 74HCT165 are high-speed Si-gate CMOS devices that comply with

JEDEC standard no. 7A. They are pin compatible with Low-power Schottky TTL (LSTTL).

The 74HC165; 74HCT165 are 8-bit parallel-load or serial-in shift registers with

complementary serial outputs (Q7 and Q7) available from the last stage. When the

parallel load (PL) input is LOW, parallel data from the D0 to D7 inputs are loaded into the

When PL is HIGH, data enters the register serially at the DS input and shifts one place to

the right (Q0 → Q1 → Q2, etc.) with each positive-going clock transition. This feature

allows parallel-to-serial converter expansion by tying the Q7 output to the DS input of the

succeeding stage.

The clock input is a gated-OR structure which allows one input to be used as an active

LOW clock enable (CE) input. The pin assignment for the CP and CE inputs is arbitrary

and can be reversed for layout convenience. The LOW-to-HIGH transition of input CE

should only take place while CP HIGH for predictable operation. Either the CP or the CE

should be HIGH before the LOW-to-HIGH transition of PL to prevent shifting the data

when PL is activated.

2. Features

I Asynchronous 8-bit parallel load

I Synchronous serial input

I Complies with JEDEC standard no. 7A

I ESD protection:

N HBM JESD22-A114E exceeds 2000 V

N MM JESD22-A115-A exceeds 200 V

I Speciﬁed from −40 °C to +85 °C and from −40 °C to +125 °C

3. Applications

I Parallel-to-serial data conversion

12 3 4 5 6 7...22

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型号	品牌	获取价格	描述	数据表
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74HCT165PW,118	NXP	获取价格	74HC(T)165 - 8-bit parallel-in/serial-out shift register TSSOP 16-Pin
74HCT165PW-Q100	NXP	获取价格	HCT SERIES, 8-BIT RIGHT PARALLEL IN SERIAL OUT SHIFT REGISTER, COMPLEMENTARY OUTPUT, PDSO1
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