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74F174SC

更新时间： 2024-01-22 12:24:52

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德州仪器 - TI		光电二极管输出元件逻辑集成电路触发器
页数	文件大小	规格书
10页	410K
描述
F/FAST SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO16, 0.150 INCH, SOIC-16

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技术参数
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74F174SC 技术参数

生命周期：	Obsolete	包装说明：	0.150 INCH, SOIC-16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.3	Is Samacsys：	N
系列：	F/FAST	JESD-30 代码：	R-PDSO-G16
长度：	9.9 mm	逻辑集成电路类型：	D FLIP-FLOP
位数：	6	功能数量：	1
端子数量：	16	最高工作温度：	70 °C
最低工作温度：		输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	传播延迟（tpd）：	11 ns
座面最大高度：	1.753 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	TTL
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
触发器类型：	POSITIVE EDGE	宽度：	3.9 mm
最小 fmax：	80 MHz	Base Number Matches：	1

74F174SC 数据手册

Unit Loading/Fan Out

54F/74F

Pin Names

Description

U.L.

Input I /I

IH IL

Output I /I

HIGH/LOW

OH OL

20 mA/ 0.6 mA

D –D

Data Inputs

1.0/1.0

50/33.3

Clock Pulse Input (Active Rising Edge)

Master Reset Input (Active LOW)

Outputs

Q –Q

1 mA/20 mA

Functional Description

Truth Table

The ’F174 consists of six edge-triggered D flip-flops with

individual D inputs and Q outputs. The Clock (CP) and Mas-

ter Reset (MR) are common to all flip-flops. Each D input’s

state is transferred to the corresponding flip-flop’s output

following the LOW-to-HIGH Clock (CP) transition. A LOW

input to the Master Reset (MR) will force all outputs LOW

independent of Clock or Data inputs. The ’F174 is useful for

applications where the true output only is required and the

Clock and Master Reset are common to all storage ele-

ments.

Inputs

Outputs

HIGH Voltage Level

LOW Voltage Level

Immaterial

LOW-to-HIGH Clock Transition

Logic Diagram

TL/F/9489–4

Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.

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