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72V805L20PFG8

更新时间： 2024-11-26 20:39:35

品牌	Logo	应用领域
艾迪悌 - IDT		先进先出芯片
页数	文件大小	规格书
26页	200K
描述
FIFO, 256X18, 12ns, Synchronous, CMOS, PQFP128, GREEN, TQFP-128

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72V805L20PFG8 技术参数

生命周期：	Obsolete	包装说明：	TQFP-128
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.84
最长访问时间：	12 ns	周期时间：	20 ns
JESD-30 代码：	R-PQFP-G128	长度：	20 mm
内存密度：	4608 bit	内存宽度：	18
功能数量：	1	端子数量：	128
字数：	256 words	字数代码：	256
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	256X18
可输出：	YES	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	RECTANGULAR
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	14 mm	Base Number Matches：	1

72V805L20PFG8 数据手册

IDT72V805

IDT72V815

IDT72V825

IDT72V835

IDT72V845

3.3 VOLT CMOS DUAL SyncFIFO™

DUAL 256 x 18, DUAL 512 x 18,

DUAL 1,024 x 18, DUAL 2,048 x 18

and DUAL 4,096 x 18

• Easily expandable in depth and width

FEATURES:

• Asynchronous or coincident Read and Write Clocks

• Asynchronous or synchronous programmable Almost-Empty

and Almost-Full flags with default settings

• The IDT72V805 is equivalent to two IDT72V205 256 x 18 FIFOs

• The IDT72V815 is equivalent to two IDT72V215 512 x 18 FIFOs

• The IDT72V825 is equivalent to two IDT72V225 1,024 x 18 FIFOs

• The IDT72V835 is equivalent to two IDT72V235 2,048 x 18 FIFOs

• The IDT72V845 is equivalent to two IDT72V245 4,096 x 18 FIFOs

• Offers optimal combination of large capacity (8K), high speed,

design flexibility, and small footprint

• Half-Full flag capability

• Output enable puts output data bus in high-impedance state

• High-performance submicron CMOS technology

• Available in a 128-pin thin quad flatpack (TQFP)

• Industrial temperature range (–40°C to +85°C) is available

• Green parts available, see ordering information

• Ideal for the following applications:

– Network switching

– Two level prioritization of parallel data

– Bidirectional data transfer

– Bus-matching between 18-bit and 36-bit data paths

– Width expansion to 36-bit per package

– Depth expansion to 8,192 words per package

• 10 ns read/write cycle time

• 5V input tolerant

• IDT Standard or First Word Fall Through timing

• Single or double register-buffered Empty and Full Flags

DESCRIPTION:

The IDT72V805/72V815/72V825/72V835/72V845 are dual 18-bit-wide

synchronous (clocked) First-in, First-out (FIFO) memories designed to run

off a 3.3V supply for exceptionally low power consumption. One dual

IDT72V805/72V815/72V825/72V835/72V845deviceisfunctionallyequiva-

lent to two IDT72V205/72V215/72V225/72V235/72V245 FIFOs in a single

package with all associated control, data, and flag lines assigned to

independent pins. These devices are very high-speed, low-power First-In,

FUNCTIONAL BLOCK DIAGRAM

HFA/(WXOA)

FFA/IRA

PAEA

EFA/

ORA

WCLKA

WENA

WCLKB

DA0-DA17

LDA

WENB

DB0-DB17

LDB

PAFA

INPUT

OFFSET

INPUT

OFFSET

FFB/IRB

FLAG

PAFB

WRITE

FLAG

LOGIC

WRITE

EFB/ORB

PAEB

HFB/(WXOB)

RAM

CONTROL

LOGIC

CONTROL

LOGIC

RAM

ARRAY

256 x 18

512 x 18

1,024 x 18

2,048 x 18

4,096 x 18

256 x 18

512 x 18

1,024 x 18

2,048 x 18

4,096 x 18

READ

POINTER

WRITE

POINTER

READ

POINTER

WRITE

POINTER

FLA

WXIA

(HFA)/WXOA

RXIA

READ

CONTROL

LOGIC

READ

CONTROL

LOGIC

EXPANSION

LOGIC

EXPANSION

LOGIC

OUTPUT

RXOA

RESET

LOGIC

RSA

RESET

LOGIC

RSB

RXOB

RXIB

(HFB)/WXOB

WXIB

FLB

RCLKB

RCLKA

OEB

QA0-QA17

RENB

RENA

OEA

QB0-QB17

4295 drw 01

IDTandtheIDTlogoareregisteredtrademarksofIntegratedDeviceTechnology, Inc. TheSyncFIFOisatrademarkofIntegratedDeviceTechnology, Inc.

COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES

NOVEMBER 2016

DSC-4295/6

12 3 4 5 6 7...26

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