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7133SA70PF

更新时间： 2023-02-26 14:12:59
品牌 Logo 应用领域
艾迪悌 - IDT 静态存储器
页数 文件大小 规格书
16页 137K
描述
Dual-Port SRAM, 2KX16, 70ns, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, TQFP-100

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7133SA70PF 数据手册

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IDT7133SA/LA,IDT7143SA/LA  
High-Speed 2K x 16 Dual-Port RAM  
Military, Industrial and Commercial Temperature Ranges  
AC Electrical Characteristics Over the  
OperatingTemperatureandSupplyVoltage(3)  
7133X20  
7143X20  
7133X25  
7143X25  
Com'l, Ind  
& Military  
7133X35  
7143X35  
Com'l, Ind  
& Military  
Com'l Only  
Symbol  
Parameter  
Min.  
Max.  
Min.  
Max.  
Min.  
Max.  
Unit  
READ CYCLE  
____  
____  
____  
t
RC  
AA  
ACE  
AOE  
OH  
LZ  
HZ  
PU  
PD  
Read Cycle Time  
20  
25  
35  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
____  
____  
____  
t
Address Access Time  
20  
20  
25  
25  
35  
35  
____  
____  
____  
____  
____  
____  
t
Chip Enable Access Time  
t
Output Enable Access Time  
Output Hold from Address Change  
Output Low-Z Time(1,2)  
12  
15  
20  
____  
____  
____  
t
0
0
0
____  
____  
____  
t
0
0
0
Output High-Z Time(1,2)  
12  
15  
20  
____  
____  
____  
t
t
Chip Enable to Power Up Time(2)  
Chip Disable to Power Down Time(2)  
0
0
0
____  
____  
____  
____  
____  
____  
t
20  
50  
50  
ns  
2746 tbl 10a  
7133X45  
7133X55  
7143X55  
Com'l, Ind  
& Military  
7133X70/90  
7143X45  
Com'l &  
Military  
7143X70/90  
Com'l &  
Military  
Symbol  
Parameter  
Min.  
Max.  
Min.  
Max.  
Min.  
Max.  
Unit  
READ CYCLE  
____  
____  
____  
tRC  
tAA  
tACE  
tAOE  
tOH  
tLZ  
Read Cycle Time  
45  
55  
70/90  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
____  
____  
____  
Address Access Time  
45  
45  
55  
55  
70/90  
70/90  
____  
____  
____  
____  
____  
____  
Chip Enable Access Time  
Output Enable Access Time  
Output Hold from Address Change  
Output Low-Z Time(1,2)  
25  
30  
40/40  
____  
____  
____  
0
0
0/0  
____  
____  
____  
0
5
5/5  
Output High-Z Time(1,2)  
20  
20  
25/25  
____  
____  
____  
tHZ  
tPU  
tPD  
Chip Enable to Power Up Time(2)  
Chip Disable to Power Down Time(2)  
0
0
0/0  
____  
____  
____  
____  
____  
____  
50  
50  
50/50  
ns  
2746 tbl 10b  
NOTES:  
1. Transition is measured 0mV fromLow or High-impedance voltage with load (Figure 2).  
2. This parameter is guaranteed by device characterization, but is not production tested.  
3. 'X' in part number indicates power rating (SA or LA).  
7
6.42  
1...45678910...16

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