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70P2352-IEL/A04R/F

更新时间： 2024-01-29 19:34:07

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TERIDIAN		/
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Telecom IC,

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70P2352-IEL/A04R/F 技术参数

生命周期：	Obsolete	Reach Compliance Code：	unknown
风险等级：	5.65	Base Number Matches：	1

70P2352-IEL/A04R/F 数据手册

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78P2352 Dual Channel OC-3/STM1-E/E4 Line Interface Unit

LEGEND

TYPE DESCRIPTION

R/W Read or Write

R/O

Read only

R/C

Read and Clear

GLOBAL REGISTERS

ADDRESS 0-0: MASTER CONTROL REGISTER

DFLT

BIT

NAME

TYPE

DESCRIPTION

Line Rate Selection:

VALUE

Selects the line rate of all channels as well as the input clock frequency

at the CKREFP/N pins.

R/W

0: OC-3, STS-3, STM-1 (155.52MHz)

1: E4 (139.264MHz)

R/W

Unused

Serial/Parallel Interface Selection:

Selects the interface to the framer.

0: Serial LVPECL

PAR

1: 4-bit Parallel CMOS

Reference Clock Frequency Selection:

Selects the reference clock frequency input at CKREFP/N pins.

11: 155.52MHz / 139.264MHz (differential)

10: 77.76MHz / NA (single-ended)

CKSL

[1:0]

4:3

R/W

00: 19.44MHz / 17.408MHz (single-ended)

Secondary values correspond to E4 frequencies. Default values depend

on the CKSL pin selection upon reset.

2:1

R/W

Reserved.

SRST

When this bit is set, all registers are reset to their default values. This

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