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633E1506A3T

更新时间： 2023-06-15 00:00:00

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LVPECL Output Clock Oscillator

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633E1506A3T 数据手册

Model 633

Very Low Jitter LVPECL or LVDS Clock

Electrical Specifications

Output Parameters

PARAMETER

SYMBOL

CONDITIONS

MIN

TYP

MAX

UNIT

Start Up Time

T_S

Application of V_CC

Enable Function [Standby]

Enable Input Voltage

Disable Input Voltage

Disable Time

V_IH

V_IL

Pin 1 or 2 Logic '1', Output Enabled

Pin 1 or 2 Logic '0', Output Disabled

Pin 1 or 2 Logic '1', Output Enabled

Bandwidth 12 kHz - 20 MHz

0.7V_CC

0.3V_CC

T_PLZ

200

Enable Time

T_PLZ

Phase Jitter, RMS

Period Jitter, RMS

Period Jitter, pk-pk

tjrms

pjrms

pjpk-pk

300

2.6

500

Enable Truth Table

Pin 1 or Pin 2

Logic ‘1’

Open

Pin 4 & Pin 5

Output

Logic ‘0’

High Imp.

Test Circuit

LVPECL

LVDS

Output Waveform

LVPECL or LVDS

DOC# 008-0578-0 Rev. B

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