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54ACTQ374MDA

更新时间： 2024-02-19 16:02:53

品牌	Logo	应用领域
美国国家半导体 - NSC		驱动输出元件逻辑集成电路
页数	文件大小	规格书
8页	173K
描述
IC ACT SERIES, 8-BIT DRIVER, TRUE OUTPUT, UUC20, DIE, Bus Driver/Transceiver

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技术参数
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54ACTQ374MDA 技术参数

生命周期：	Obsolete	包装说明：	DIE,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.68	系列：	ACT
JESD-30 代码：	R-XUUC-N20	逻辑集成电路类型：	BUS DRIVER
位数：	8	功能数量：	1
端口数量：	2	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	UNSPECIFIED	封装代码：	DIE
封装形状：	RECTANGULAR	封装形式：	UNCASED CHIP
传播延迟（tpd）：	11.5 ns	认证状态：	Not Qualified
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子形式：	NO LEAD	端子位置：	UPPER
Base Number Matches：	1

54ACTQ374MDA 数据手册

Connection Diagrams (Continued)

Pin Names

D₀–D₇

Description

Data Inputs

Clock Pulse Input

TRI-STATE Output Enable Input

TRI-STATE Outputs

O₀–O₇

Functional Description

Truth Table

The ’ACQ/’ACTQ374 consists of eight edge-triggered

flip-flops with individual D-type inputs and TRI-STATE true

outputs. The buffered clock and buffered Output Enable are

common to all flip-flops. The eight flip-flops will store the

state of their individual D inputs that meet the setup and hold

time requirements on the LOW-to-HIGH Clock (CP) transi-

tion. With the Output Enable (OE) LOW, the contents of the

eight flip-flops are available at the outputs. When the OE is

HIGH, the outputs go to the high impedance state. Operation

of the OE input does not affect the state of the flip-flops.

Inputs

Outputs

D_n

O_n

HIGH Voltage Level

LOW Voltage Level

Immaterial

High Impedance

N =

LOW-to-HIGH Transition

Logic Diagram

DS100239-5

Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.

www.national.com

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