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Datasheet > 转换器 > 模数转换器> 5102ALP-RP-F-K
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5102ALP-RP-F-K

更新时间： 2024-02-17 23:12:33
品牌 Logo 应用领域
麦斯威 - MAXWELL 转换器
页数 文件大小 规格书
14页 250K
描述
16-Bit, 20 KHz A/D Converter

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5102ALP-RP-F-K 技术参数

生命周期：Contact Manufacturer零件包装代码：DFP
包装说明：RAD PACK, LDFP-44针数：44
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.56
Is Samacsys：N最大模拟输入电压：5 V
最小模拟输入电压：-2.5 V转换器类型：ADC, PROPRIETARY METHOD
JESD-30 代码：R-XDFP-F44长度：27.94 mm
最大线性误差 (EL)：0.0046%标称负供电电压：-5 V
模拟输入通道数量：2位数：16
功能数量：1端子数量：44
最高工作温度：55 °C最低工作温度：-15 °C
输出位码：BINARY输出格式：SERIAL
封装主体材料：UNSPECIFIED封装代码：DFP
封装等效代码：FL44,.5封装形状：RECTANGULAR
封装形式：FLATPACK电源：5 V
认证状态：Not Qualified采样速率：0.02 MHz
座面最大高度：7.8232 mm子类别：Analog to Digital Converters
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL宽度：14.478 mm
Base Number Matches：1

5102ALP-RP-F-K 数据手册

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16-Bit, 20 KHz A/D Converter  
5102ALP  
TABLE 4. 5102ALP SWITCHING CHARACTERISTICS  
(T = TMIN TO TMAX; VA+, VD+ = 5V ± 10%; VA-, VD- = -5V ± 10%; INPUTS: LOGIC 0 = 0V, LOGIC 1 = VD+; CL = 50 PF)  
A
PARAMETER  
SYMBOL  
MIN  
TYP  
MAX  
UNIT  
Crystal Frequency 1, 2  
fxtal  
--  
1.6  
--  
MHz  
ms  
ns  
SLEEP Rising to Oscillator Stable 3  
RST Pulse Width 4  
--  
150  
--  
20  
--  
trst  
tdrrs  
--  
--  
RST to STBY Falling  
100  
--  
ns  
RST Rising to STBY Rising  
CH1/2 Edge to TRK1, TRK2 Rising 5  
CH1/2 Edge to TRK1, TRK2 Falling 5  
HOLD to SSH Falling 6  
tcal  
--  
2,882,040  
--  
--  
tclk  
ns  
tdrsh1  
tdfsh4  
tdfsh2  
tdfsh1  
tdrsh  
thold  
tdhlri  
thcf  
--  
80  
--  
--  
68tclk + 260  
--  
ns  
--  
60  
--  
ns  
HOLD to TRK1, TRK2, Falling 6  
HOLD to TRK1, TRK2, SSH Rising 6  
HOLD Pulse Width 7  
66tclk  
--  
68tclk + 260  
--  
ns  
120  
--  
ns  
1tclk + 20  
300  
275  
63tclk  
ns  
HOLD to CH1/2 Edge 6  
HOLD Falling to CLKIN Falling 7  
--  
64tclk  
ns  
--  
1tclk + 10  
ns  
PDT and RBT Modes  
SCLK Input Pulse Period  
tsclk  
tsckll  
tsclkh  
tdss  
1000  
500  
500  
--  
--  
--  
--  
--  
ns  
ns  
ns  
ns  
ns  
ns  
SCLK Input Pulse Width Low  
SCLK Input Pulse Width High  
SCLK Input Falling to SDATA Valid  
HOLD Falling to SDATA Valid - PDT Mode  
TRK1, TRK2 Falling to SDATA Valid 8  
FRN and SSC Modes  
--  
--  
100  
140  
65  
150  
230  
125  
tdhs  
--  
tdts  
--  
SCLK Output Pulse Width Low  
SCLK Output Pulse Width High  
SDATA Valid Before Rising SCLK  
SDATA Valid After Rising SCLK  
SDL Falling to 1st Rising SCLK  
Last Rising SCLK to SDL Rising  
HOLD Falling to 1st Falling SCLK  
CH1/2 Edge to 1st Falling SCLK  
tslkl  
tslkh  
tss  
--  
2tclk  
2tclk  
--  
--  
tclk  
tclk  
ns  
ns  
ns  
ns  
ns  
tclk  
--  
--  
2tclk - 100  
--  
tsh  
2tclk - 100  
--  
--  
--  
trsclk  
trsdl  
thfs  
--  
--  
2tclk  
2tclk  
--  
2tclk + 200  
8tclk + 200  
--  
6tclk  
--  
tchfs  
7tclk  
1. Minimum CLKIN period is 0.625 µs is FRN mode (20 kHz sample rate).  
2. External loading capacitors are required to allow the crystal to oscillate. Maximum crystal frequency is 1.6 MHz in FRN mode  
(20 kHz sample rate).  
3. With a 2.0 MHz crystal, two 33 pF loading capacitors and a 10 MW parallel resistor.  
4. Guaranteed by initial characterization (5102A die).  
5. These times are for FRN mode.  
6. These times are for PDT and RBT modes.  
All data sheets are subject to change without notice  
5
01.17.05 REV 3  
©2005 Maxwell Technologies Inc.  
All rights reserved.  
12345678...14

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