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49FCT20805NDGPYGI

更新时间: 2024-01-11 08:47:46
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艾迪悌 - IDT 时钟驱动器
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8页 67K
描述
2.5V CMOS DUAL 1-TO-5 CLOCK DRIVER

49FCT20805NDGPYGI 技术参数

是否无铅:不含铅是否Rohs认证:符合
生命周期:Active零件包装代码:SSOP
包装说明:SSOP-20针数:20
Reach Compliance Code:compliantECCN代码:EAR99
HTS代码:8542.39.00.01风险等级:2.08
Samacsys Confidence:3Samacsys Status:Released
2D Presentation:https://componentsearchengine.com/2D/0T/1688049.2.1.pngSchematic Symbol:https://componentsearchengine.com/symbol.php?partID=1688049
PCB Footprint:https://componentsearchengine.com/footprint.php?partID=16880493D View:https://componentsearchengine.com/viewer/3D.php?partID=1688049
Samacsys PartID:1688049Samacsys Image:https://componentsearchengine.com/Images/9/49FCT20805PYGI.jpg
Samacsys Thumbnail Image:https://componentsearchengine.com/Thumbnails/2/49FCT20805PYGI.jpgSamacsys Pin Count:20
Samacsys Part Category:Integrated CircuitSamacsys Package Category:Small Outline Packages
Samacsys Footprint Name:PYG20-1Samacsys Released Date:2020-01-14 15:14:15
Is Samacsys:N系列:FCT
输入调节:STANDARDJESD-30 代码:R-PDSO-G20
JESD-609代码:e3长度:7.2 mm
逻辑集成电路类型:LOW SKEW CLOCK DRIVER最大I(ol):0.008 A
湿度敏感等级:1功能数量:2
反相输出次数:端子数量:20
实输出次数:5最高工作温度:85 °C
最低工作温度:-40 °C输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY封装代码:SSOP
封装等效代码:SSOP20,.3封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, SHRINK PITCH峰值回流温度(摄氏度):260
电源:2.5 VProp。Delay @ Nom-Sup:3 ns
传播延迟(tpd):3 ns认证状态:Not Qualified
Same Edge Skew-Max(tskwd):0.27 ns座面最大高度:1.99 mm
子类别:Clock Drivers最大供电电压 (Vsup):2.7 V
最小供电电压 (Vsup):2.3 V标称供电电压 (Vsup):2.5 V
表面贴装:YES技术:CMOS
温度等级:INDUSTRIAL端子面层:Matte Tin (Sn) - annealed
端子形式:GULL WING端子节距:0.65 mm
端子位置:DUAL处于峰值回流温度下的最长时间:30
宽度:5.3 mmBase Number Matches:1

49FCT20805NDGPYGI 数据手册

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IDT49FCT20805  
2.5VCMOSDUAL1-TO-5CLOCKDRIVER  
INDUSTRIALTEMPERATURERANGE  
TESTCIRCUITSANDWAVEFORMS  
4.6V  
VCC  
Open  
GND  
500  
500  
VIN  
VOUT  
Pulse  
Generator  
D.U.T  
RL  
CL  
RT  
Enable and Disable Time Circuit  
2.5V  
1.25V  
0V  
VCC  
INPUT  
tPLH1  
tPHL1  
VOH  
1.25V  
VOL  
VIN  
VOUT  
OUTPUT 1  
OUTPUT 2  
Pulse  
Generator  
D.U.T  
tSK(o)  
tSK(o)  
RL  
VOH  
1.25V  
VOL  
CL  
RT  
tPLH2  
tPHL2  
tSK(o) = |tPLH2 - tPLH1| or |tPHL2 - tPHL1|  
Output Skew - tSK(O)  
CL = 15pF Test Circuit  
SWITCHPOSITION  
TESTCONDITIONS  
Symbol  
VCC = 2.5V ±0.2V  
Unit  
Test  
Switch  
CL  
15  
pF  
ns  
Disable Low  
Enable Low  
4.6V  
RT  
ZOUT ofpulsegenerator  
33  
Disable High  
Enable High  
GND  
RL  
tR / tF  
1 (0V to 2.5V or 2.5V to 0V)  
DEFINITIONS:  
CL = Load capacitance: includes jig and probe capacitance.  
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.  
tR / tF = Rise/Fall time of the input stimulus from the Pulse Generator.  
6

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