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Z9308-1CT

更新时间： 2024-02-11 11:11:41

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
10页	84K
描述
PLL Based Clock Driver, PDSO16, TSSOP-16

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Z9308-1CT 技术参数

生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.72	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e0	长度：	5 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	端子数量：	16
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
认证状态：	Not Qualified	座面最大高度：	1.2 mm
表面贴装：	YES	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	宽度：	4.4 mm
Base Number Matches：	1

Z9308-1CT 数据手册

Z9308

Zero Delay Clock Buffer

Preliminary

Operating Conditions

Parameter

Description

Min.

3.0

Max.

3.6

Unit

VDD

Supply Voltage

Operating Temperature (Ambient Temperature

Output Capacitance

^oC

Cout

CIN

Input Capacitance

Load Capacitance

DC Electrical Characteristics

Parameters

Symbol Min

Typ

Max

0.8

Units

Vdc

µA

Conditions

Input Low Voltage⁽¹⁾

Input High Voltage⁽¹⁾

Input Low Current

VIL

VIH

IIL₁

2.0

100

0.4

VIN = 0 V

Input High Current

Output Low Voltage²

Output High Voltage²

Tri-State leakage Current

Dynamic Supply Current

IIH₁

VOL

VOH

Ioz⁽³⁾

Idd

µA

VIN = VDD

IOL = 12 mA

IOH = - 12 mA

V_O= 3.3 V

2.4

16.5

µA

Unload outputs, 66.66 MHz, Select inputs

at VDD or GND.

Static Supply Current

Isdd

S1 = S2 = VSS – VIN = VDD or VSS

µA

Notes:

1. REF and FBK inputs have a threshold voltage of V_DD/2.

2. Output (clock) pins have pulldown devices attached internally.

3. Weak pulldown is active when the output buffers are tri-stated. The value of this pulldown resistor is >200kΩ <1.55

mΩ, typically 550kΩ.

INTERNATIONAL MICROCIRCUITS, INC. 525 LOS COCHES ST.

MILPITAS, CA 95035. TEL: 408-263-6300. FAX 408-263-6571

Rev. 1.3

3/9/00

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型号	品牌	描述	获取价格	数据表
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