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XA6SLX100-2FGG484Q PDF预览

XA6SLX100-2FGG484Q

更新时间： 2024-01-26 15:33:29
品牌 Logo 应用领域
赛灵思 - XILINX 时钟栅可编程逻辑
页数 文件大小 规格书
10页 288K
描述
Field Programmable Gate Array, 667MHz, 101261-Cell, CMOS, PBGA484,

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XA6SLX100-2FGG484Q 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：ActiveReach Compliance Code：compliant
ECCN代码：3A991.DHTS代码：8542.39.00.01
Factory Lead Time：12 weeks风险等级：5.59
最大时钟频率：667 MHzJESD-30 代码：S-PBGA-B484
JESD-609代码：e1湿度敏感等级：3
输入次数：326逻辑单元数量：101261
输出次数：326端子数量：484
封装主体材料：PLASTIC/EPOXY封装代码：BGA
封装等效代码：BGA484,22X22,40封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：250
电源：1.2,1.2/3.3,2.5/3.3 V可编程逻辑类型：FIELD PROGRAMMABLE GATE ARRAY
认证状态：Not Qualified筛选级别：AEC-Q100
子类别：Field Programmable Gate Arrays表面贴装：YES
技术：CMOS端子面层：Tin/Silver/Copper (Sn96.5Ag3.0Cu0.5)
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：30
Base Number Matches：1

XA6SLX100-2FGG484Q 数据手册

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XA Spartan-6 Automotive FPGA Family Overview  
XA Spartan-6 FPGA Feature Summary  
Table 1: XA Spartan-6 FPGA Feature Summary by Device  
Configurable Logic Blocks (CLBs)  
Block RAM Blocks  
Memory  
Endpoint  
Maximum  
GTP  
Total Max  
I/O User  
Logic  
DSP48A1  
Controller  
Blocks  
(Max)  
(5)  
Device  
Max  
CMTs  
Blocks for  
(1)  
(3)  
Cells  
Slices  
(2)  
(4)  
Slices  
Flip-Flops Distributed  
RAM (Kb)  
18 Kb  
Max (Kb)  
PCI Express Transceivers Banks I/O  
XA6SLX4  
3,840  
9,152  
600  
1,430  
2,278  
3,758  
6,822  
11,662  
4,800  
11,440  
18,224  
30,064  
54,576  
93,296  
75  
8
12  
32  
32  
52  
216  
576  
2
2
2
2
4
6
6
2
4
6
0
2
2
2
2
2
2
2
2
2
0
0
0
0
0
0
0
1
1
1
0
0
0
0
0
0
0
2
4
4
4
4
4
4
4
4
4
4
4
4
132  
200  
232  
266  
320  
328  
326  
250  
296  
268  
XA6SLX9  
90  
16  
XA6SLX16  
XA6SLX25  
XA6SLX45  
XA6SLX75  
XA6SLX100  
XA6SLX25T  
XA6SLX45T  
XA6SLX75T  
14,579  
24,051  
43,661  
74,637  
136  
229  
401  
692  
976  
229  
401  
692  
32  
576  
38  
936  
58  
116  
172  
268  
52  
2,088  
3,096  
4,824  
936  
132  
180  
38  
101,261 15,822 126,576  
24,051  
43,661  
74,637  
3,758  
6,822  
30,064  
54,576  
93,296  
58  
116  
172  
2,088  
3,096  
11,662  
132  
Notes:  
1. XA Spartan-6 FPGA logic cell ratings reflect the increased logic cell capability offered by the new 6-input LUT architecture.  
2. Each XA Spartan-6 FPGA slice contains four LUTs and eight flip-flops.  
3. Each DSP48A1 slice contains an 18 x 18 multiplier, an adder, and an accumulator.  
4. Block RAMs are fundamentally 18 Kb in size. Each block can also be used as two independent 9 Kb blocks.  
5. Each CMT contains two DCMs and one PLL.  
FPGA Device Package Combinations and Available I/Os  
XA Spartan-6 FPGA package combinations with the available I/Os and GTP transceivers per package are shown in Table 2.  
Due to the transceivers, the LX and LXT pinouts are not compatible.  
Table 2: XA Spartan-6 Device-Package Combinations and Maximum Available I/Os  
Package(1)  
Size (mm)  
Pitch (mm)  
Device  
CSG225(2)  
13 x 13  
0.8  
FTG256  
17 x 17  
1.0  
CSG324  
15 x 15  
0.8  
CSG484(3)  
19 x 19  
0.8  
FGG484(3)  
23 x 23  
1.0  
User I/O  
132  
User I/O  
GTPs  
User I/O  
GTPs  
User I/O  
GTPs  
User I/O  
XA6SLX4  
XA6SLX9  
160  
186  
186  
186  
NA  
NA  
NA  
NA  
200  
232  
226  
218  
XA6SLX16  
XA6SLX25  
XA6SLX45  
XA6SLX75  
XA6SLX100  
XA6SLX25T  
XA6SLX45T  
XA6SLX75T  
160  
NA  
NA  
NA  
NA  
2
266  
316  
280  
326  
250  
296  
268  
NA  
NA  
320  
328  
2
4
190  
190  
4
4
Notes:  
1. XA Spartan-6 devices are available in Pb-free packages only.  
2. Memory controller block support is x8 on the XA6SLX9 and XA6SLX16 devices in the CSG225 package. There is no memory controller in the  
XA6SLX4.  
3. These packages support two of the four memory controllers in the XA6SLX75, XA6SLX75T, and XA6SLX100 devices.  
DS170 (v1.3) December 13, 2012  
www.xilinx.com  
Product Specification  
2
 
 
1234567...10

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