TAA5212
ZHCSPM8 –JANUARY 2022
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表9-1. 设计参数
值
参数
AVDD
IOVDD
3.3V
1.2V、1.8V 或3.3V
AVDD 电源电流消耗
待定
待定
5mA
IOVDD 电源电流消耗
最大MICBIAS 电流
9.2.3 详细设计过程
本节介绍了为此特定应用配置TAA5212 的必要步骤。以下步骤提供了从器件上电到从器件读取数据或从一种工作
模式切换到另一种工作模式之间必须执行的一系列项目。
1. 为器件通电:
a. 为IOVDD 和AVDD 电源加电
b. 等待至少1ms,让器件初始化内部寄存器。
c. 器件现在进入睡眠模式(低功耗模式< 10µA)
2. 每次操作需要时,从睡眠模式切换到工作模式:
a. 通过写入P0_R2 以禁用睡眠模式来唤醒器件
b. 等待至少1ms,让器件完成内部唤醒序列
c. 根据需要覆盖默认配置寄存器或可编程系数值(这一步是可选操作)
d. 通过写入P0_R118 来启用所有需要的输入通道
e. 通过写入ADC 的P0_R30 至P0_R37 来启用所有需要的音频串行接口输入/输出通道
f. 通过写入P0_R120 来为ADC 和MICBIAS 加电
g. 施加具有所需输出采样速率和BCLK 与FSYNC 之比的FSYNC 和BCLK
该特定步骤可以在步骤a 后序列的任意时间点完成。
有关支持的采样速率和BCLK 与FSYNC 之比,请参阅节8.3.3。
h. 现在使用TDM 音频串行数据总线将器件记录数据发送到主机处理器,并且来自TDM 的回放数据现在通
过线路输出进行播放
3. 根据系统的低功耗运行要求,从工作模式(再次)切换到睡眠模式:
a. 通过写入P0_R2 以启用睡眠模式来进入睡眠模式
b. 等待至少6ms(FSYNC = 48kHz 时),让音量下降并让所有模块断电
c. 读取P0_R122 以检查器件关断和睡眠模式状态
d. 如果器件P0_R122_D[7:5] 状态位为3'b100,则停止系统中的FSYNC 和BCLK
e. 器件现在进入睡眠模式(低功耗模式< 10µA)并保留所有寄存器值
4. 根据录音操作需要,从睡眠模式(再次)切换到工作模式:
a. 通过写入P0_R2 以禁用睡眠模式来唤醒器件
b. 等待至少1ms,让器件完成内部唤醒序列
c. 施加具有所需输出采样速率和BCLK 与FSYNC 之比的FSYNC 和BCLK
d. 现在使用TDM 音频串行数据总线将器件记录数据发送到主机处理器,并且来自TDM 的回放数据现在通
过线路输出进行播放
5. 根据模式转换要求,重复步骤4 和步骤5
9.2.4 应用性能曲线图
图9-2.
9.2.5 该做什么和不该做什么
图9-3.
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English Data Sheet: SLASF30
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