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QL2003-0PF100C

更新时间： 2024-01-10 20:12:36

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Field Programmable Gate Array (FPGA)

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QL2003-0PF100C 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	TQFP-100
针数：	100	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.88
Is Samacsys：	N	其他特性：	CAN ALSO BE OPERATED AT 3.3 V
最大时钟频率：	200 MHz	CLB-Max的组合延迟：	9.275 ns
JESD-30 代码：	S-PQFP-G100	JESD-609代码：	e0
长度：	14 mm	湿度敏感等级：	3
可配置逻辑块数量：	192	等效关口数量：	5000
输入次数：	74	逻辑单元数量：	192
输出次数：	66	端子数量：	100
最高工作温度：	70 °C	最低工作温度：
组织：	192 CLBS, 5000 GATES	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装等效代码：	QFP100,.63SQ,20
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	3.3/5 V
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
座面最大高度：	1.6 mm	子类别：	Field Programmable Gate Arrays
最大供电电压：	5.25 V	最小供电电压：	4.75 V
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	14 mm
Base Number Matches：	1

QL2003-0PF100C 数据手册

QL2003

3.3V and 5.0V pASIC 2 FPGA

Combining Speed, Density, Low Cost and Flexibility

Rev. C

pASIC 2

HIGHLIGHTS

Ultimate Verilog/VHDL Silicon Solution

-Abundant, high-speed interconnect eliminates manual routing

-Flexible logic cell provides high efficiency and performance

-Design tools produce fast, efficient Verilog/VHDL synthesis

Speed, Density, Low Cost and Flexibility in One Device

-16-bit counter speeds exceeding 200 MHz

-3,000 usable ASIC gates, 5,000 usable PLD gates, 118 I/Os

-3-layer metal ViaLink process for small die sizes

-100% routable and pin-out maintainable

… 3,000

usable ASIC gates,

118 I/O pins

Advanced Logic Cell and I/O Capabilities

-Complex functions (up to 16 inputs) in a single logic cell

-High synthesis gate utilization from logic cell fragments

-Full IEEE Standard JTAG boundary scan capability

-Individually-controlled input/feedback registers and OEs on all I/O pins

Other Important Family Features

-3.3V and 5.0V operation with low standby power

-I/O pin-compatibility between different devices in the same packages

-PCI compliant (at 5.0V), full speed 33 MHz implementations

-High design security provided by security fuses

QL2003

Block Diagram

192

Logic

Cells

3-5

12 3 4 5 6 7...10

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