PL560-68QIR

更新时间： 2025-10-14 03:12:23

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PLL		倍频器
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描述
Analog Frequency Multiplier

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PL560-68QIR 数据手册

Analog Frequency Multiplier

PL560-xx VCXO Family

PRODUCT DESCRIPTION

FEATURES

•ꢀNonꢁPLLꢀfrequencyꢀmultiplicationꢀ

•ꢀInputꢀfrequencyꢀfromꢀ30ꢁ200ꢀMHzꢀꢀ

•ꢀOutputꢀfrequencyꢀfromꢀ60ꢁ800ꢀMHzꢀꢀ

•ꢀLowꢀphaseꢀnoiseꢀandꢀjitterꢀ(equivalentꢀtoꢀfundamentalꢀ

crystalꢀatꢀtheꢀoutputꢀfrequency)ꢀ

PhaseLink’sꢀAnalogꢀFrequencyꢀMultiplier^TMꢀ(AFM)ꢀisꢀ

theꢀindustry’sꢀfirstꢀ‘BalancedꢀOscillator’ꢀutilizingꢀ

analogꢀmultiplicationꢀofꢀtheꢀfundamentalꢀfrequencyꢀ

(atꢀdoubleꢀorꢀquadrupleꢀfrequency),ꢀcombinedꢀwithꢀ

anꢀattenuationꢀofꢀtheꢀfundamentalꢀofꢀtheꢀreferenceꢀ

crystal,ꢀwithoutꢀtheꢀuseꢀofꢀaꢀphaseꢁlockedꢀloopꢀ

(PLL),ꢀinꢀCMOSꢀtechnology.ꢀ

•ꢀUltraꢁlowꢀjitterꢀ

oꢀRMSꢀphaseꢀjitterꢀ<ꢀ0.25ꢀpsꢀ(12kHzꢁ20MHz)ꢀ

oꢀRMSꢀperiodꢀjitterꢀ<ꢀ2.5ꢀpsꢀ

ꢀ

•ꢀLowꢀphaseꢀnoiseꢀ

PhaseLink’sꢀpatentꢀpendingꢀPL560ꢁxxꢀfamilyꢀofꢀAFMꢀ

productsꢀcanꢀachieveꢀupꢀtoꢀ800ꢀMHzꢀoutputꢀ

frequencyꢀwithꢀlittleꢀjitterꢀorꢀphaseꢀnoiseꢀ

deterioration.ꢀꢀInꢀaddition,ꢀtheꢀlowꢀfrequencyꢀinputꢀ

crystalꢀrequirementꢀmakesꢀtheꢀAFMsꢀtheꢀmostꢀ

affordableꢀhighꢁperformanceꢀtimingꢁsourceꢀinꢀtheꢀ

market.ꢀ

oꢀꢁ142ꢀdBc/Hzꢀ@100kHzꢀoffsetꢀfromꢀ155.52ꢀMHzꢀ

oꢀꢁ150ꢀdBc/Hzꢀ@10MHzꢀoffsetꢀfromꢀ155.52ꢀMHzꢀ

•ꢀHighꢀlinearityꢀpullꢀrangeꢀ(typ.ꢀ5%)ꢀ

•ꢀ+/ꢁꢀ120ꢀPPMꢀpullabilityꢀVCXOꢀ

•ꢀLowꢀinputꢀfrequencyꢀeliminatesꢀtheꢀneedꢀforꢀexpensiveꢀ

crystalsꢀ

•ꢀDifferentialꢀoutputꢀlevelsꢀ(PECL,ꢀLVDS),ꢀorꢀsingleꢁ

endedꢀCMOSꢀꢀ

•ꢀSingleꢀ2.5Vꢀorꢀ3.3Vꢀ+/ꢁꢀ10%ꢀpowerꢀsupplyꢀ

•ꢀOptionalꢀindustrialꢀtemperatureꢀrangeꢀ(ꢁ40°Cꢀtoꢀ+85°C)ꢀꢀ

•ꢀAvailableꢀinꢀ16ꢁpinꢀGREEN/RoHSꢀcompliantꢀTSSOP,ꢀ

andꢀ3x3ꢀQFNꢀ

ꢀ

PL560ꢁxxꢀfamilyꢀofꢀproductsꢀutilizeꢀlowꢁpowerꢀCMOSꢀ

technologyꢀandꢀareꢀhousedꢀinꢀGREEN/ RoHSꢀ

compliantꢀ16ꢁpinꢀTSSOP,ꢀandꢀ16ꢁpinꢀ3x3ꢀQFNꢀ

packages.ꢀꢀꢀꢀ

ꢀ

Figure 1: 2x AFM Phase Noise at 311.04MHz

47745ꢀFremontꢀBlvd.,ꢀFremont,ꢀCaliforniaꢀ94538ꢀꢀꢀTELꢀ(510)ꢀ492ꢁ0990,ꢀFAXꢀ(510)ꢀ492ꢁ0991ꢀwww.phaselink.com Rev.ꢀ02/09/07ꢀPageꢀ1ꢀ

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