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PI90SD1636AFDE

更新时间： 2024-02-06 09:59:16
品牌 Logo 应用领域
百利通 - PERICOM 网络接口电信集成电路电信电路以太网以太网：16GBASE-T
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15页 526K
描述
SERDES Gigabit Ethernet Transceiver

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PI90SD1636AFDE 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFP
包装说明：LQFP, QFP64,.6SQ,32针数：64
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.77
Is Samacsys：N数据速率：1250000 Mbps
JESD-30 代码：S-PQFP-G64JESD-609代码：e3
长度：14 mm湿度敏感等级：3
功能数量：1端子数量：64
收发器数量：1最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：LQFP封装等效代码：QFP64,.6SQ,32
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
认证状态：Not Qualified座面最大高度：1.6 mm
子类别：Network Interfaces标称供电电压：3.3 V
表面贴装：YES技术：CMOS
电信集成电路类型：ETHERNET TRANSCEIVER温度等级：COMMERCIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：0.8 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：14 mm
Base Number Matches：1

PI90SD1636AFDE 数据手册

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PI90SD1636A  
SERDES Gigabit Ethernet Transceiver  
Table 2. Pin Description  
Name  
Pin #  
Type  
Description  
GND_ESD  
VCC_ESD  
1, 14  
5, 10  
P
Power and ground pairs for pad ESD structure.  
TX<0>  
TX<1>  
TX<2>  
TX<3>  
TX<4>  
TX<5>  
TX<6>  
TX<7>  
TX<8>  
TX<9>  
2
3
4
6
7
8
9
11  
12  
13  
0-bit parallel data input pins. This data should be 10b/8b encoded. The least  
significant bit is TX<0> and is transmitted first.  
TTL_IN  
GND_TXA  
VCC_TXA  
15  
18  
P
Power and ground pair for TX PLL analog circuits.  
No Connect  
16, 17,27,  
48, 49  
NC  
NC  
Wrap Enable. This pin is active HIGH. When asserted, the high-speed serial data  
are internally wrapped from the transmitter serial data output back to the receiver  
data input. Also, when asserted, DOUT± are held static at logic 1. When deasserted,  
DOUT± and .DIN± are active.  
EWRAP  
19  
TTL_IN  
P
VCC_TXD  
GND_TXD  
20  
21  
Power and ground pair for TX digital circuits.  
Reference clock and transmit byte clock. This is a 125 MHz system clock supplied  
by the host system. On the positive edge of the clock, the input data, TX<9:0>, are  
latched into the register. This clock is multiplied by 10 internally, to generate the  
transmit serial bit clock.  
TX_CLK  
22  
TTL_IN  
VCC_RXD  
GND_RXD  
23 28,  
25  
P
Power and ground pair for digital circuits in the receiver portion.  
Comma Detect Enable. This pin is active HIGH. When asserted, the internal byte  
alignment function is turned on, to allow the clock to synchronize with the comma  
character (0011111XXX). When de-asserted, the function is disabled and will not align  
the clock and data. In this mode COM_DET is set to LOW.  
EN_CDET  
24  
TTL_IN  
Signal Detect. This pin is active HIGH. It indicates the loss of input signal on the  
high-speed serial inputs, DIN±. SIG_DET is set to LOW when differential inputs are  
less than 50 mV.  
TTL_  
OUT  
SIG_DET  
26  
VCC_RX  
GND_RX  
29  
32  
P
Power and ground pair for the clock signal of the receiver portion.  
Receiver Byte Clocks. Two 180 degrees out-of-phase 62.5 MHz clock signals that are  
recovered by the receiver section. The received bytes are alternately clocked by the  
rising edges of these signals. The rising edge of RX_CLK<1> aligns with a comma  
character when detected.  
RX_CLK<1> 30  
RX_CLK<0> 31  
TTL_  
OUT  
PS8641  
10/14/04  
4
1234567...15

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