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PDM41256LA15SOATY

更新时间： 2024-11-20 08:20:11

品牌	Logo	应用领域
IXYS		静态存储器光电二极管内存集成电路
页数	文件大小	规格书
8页	262K
描述
Standard SRAM, 32KX8, 15ns, CMOS, PDSO28, 0.300 INCH, PLASTIC, SOJ-28

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PDM41256LA15SOATY 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOJ
包装说明：	0.300 INCH, PLASTIC, SOJ-28	针数：	28
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.2
最长访问时间：	15 ns	JESD-30 代码：	R-PDSO-J28
长度：	18.415 mm	内存密度：	262144 bit
内存集成电路类型：	STANDARD SRAM	内存宽度：	8
功能数量：	1	端子数量：	28
字数：	32768 words	字数代码：	32000
工作模式：	ASYNCHRONOUS	最高工作温度：	105 °C
最低工作温度：	-40 °C	组织：	32KX8
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOJ
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	NOT SPECIFIED
认证状态：	Not Qualified	座面最大高度：	3.75 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7.62 mm	Base Number Matches：	1

PDM41256LA15SOATY 数据手册

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PDM41256

256K Static RAM

32K x 8-Bit

Description

Features

The PDM41256 is a high-performance CMOS static

RAM organized as 32,768 x 8 bits. Writing to this

device is accomplished when the write enable (WE)

and the chip enable (CE) inputs are both LOW.

Reading is accomplished when WE remains HIGH

and CE and OE are both LOW.

■ High-speed access times

Com’l: 7, 8, 10, 12 and 15ns

Ind’l: 8, 10, 12 and 15ns

(use 15ns for slower designs)

■ Low power operation (typical)

- PDM41256SA

Active: 475 mW

Standby: 100 mW

- PDM41256LA

Active: 425mW

The PDM41256 operates from a single +5V power

supply and all the inputs and outputs are fully TTL-

compatible. The PDM41256 comes in two versions:

the standard power version PDM41256SA and the

low power version PDM41256LA. Both versions are

functionally the same and differ only in their power

consumption.

Standby: 25 mW

■ Single +5V (±10%) power supply

■ TTL-compatible inputs and outputs

■ Packages

The PDM41256 is available in a 28-pin plastic TSOP

(I) and a 28-pin 300-mil plastic SOJ.

Plastic SOJ (300 mil) - SO

Plastic TSOP (I) - T

Functional Block Diagram

•

Decoder

Memory

•

Addresses

Matrix

•

A ₁₄

• • • • •

I/O₀

Input

Data

Control

Column I/O

•

I/O₇

•

Rev. 4.4 - 4/29/98

12 3 4 5 6 7 8

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PDM41256LA15SOTR	ETC	获取价格	x8 SRAM
PDM41256LA15SOTY	ETC	获取价格	x8 SRAM
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PDM41256LA15TA	IXYS	获取价格	Standard SRAM, 32KX8, 15ns, CMOS, PDSO28, PLASTIC, TSOP1-28
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