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Datasheet > 电信电路 > 无绳电话集成电路> PCD5092H-T
PCD5092H-T PDF预览

PCD5092H-T

更新时间： 2024-01-22 15:22:31
品牌 Logo 应用领域
恩智浦 - NXP 控制器
页数 文件大小 规格书
16页 87K
描述
IC TELECOM, CORDLESS, BASEBAND CIRCUIT, PQFP100, PLASTIC, SOT-317-2, QFP-64, Cordless Telephone IC

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PCD5092H-T 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：QFP,针数：100
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.83Is Samacsys：N
JESD-30 代码：R-PQFP-G100JESD-609代码：e3
长度：20 mm功能数量：1
端子数量：100封装主体材料：PLASTIC/EPOXY
封装代码：QFP封装形状：RECTANGULAR
封装形式：FLATPACK认证状态：Not Qualified
座面最大高度：3.2 mm标称供电电压：3 V
表面贴装：YES技术：CMOS
电信集成电路类型：CORDLESS TELEPHONE BASEBAND CIRCUIT端子面层：TIN
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD宽度：14 mm
Base Number Matches：1

PCD5092H-T 数据手册

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Philips Semiconductors  
Objective specification  
DECT baseband controller  
PCD5092  
STATE  
SYMBOL  
VSSO  
PIN  
I/O  
AFTER  
RESET  
PIN TYPE  
PIN DESCRIPTION  
34  
35  
36  
37  
38  
39  
40  
41  
42  
43  
44  
45  
46  
47  
48  
49  
50  
51  
52  
53  
54  
55  
56  
57  
58  
59  
60  
61  
62  
63  
64  
65  
66  
67  
68  
69  
70  
−
−
−
supply  
negative supply voltage for the oscillator  
positive supply voltage for the oscillator  
negative input from line interface  
positive input from line interface  
negative supply voltage for analog circuits  
negative input from microphone  
positive input from microphone  
VDDO  
−
supply  
LIFM  
I
0.7 V  
ANAIOD1  
ANAIOD1  
supply  
LIFP  
I
0.7 V  
VSSA  
−
−
MICM  
MICP  
VMIC  
Vref  
I
0.7 V  
ANAIOR1  
ANAIOR1  
ANAIOD1  
ANAIOD1  
ANAIOR1  
supply  
I
0.7 V  
O
off  
positive microphone supply voltage (+2 V)  
reference voltage (+2 V)  
O
2.0 V  
VBGP  
VDDA  
O
1.25 V  
bandgap output voltage (+1.25 V)  
positive supply voltage for analog circuits  
negative output to earpiece  
−
−
1.4 V  
1.4 V  
−
EARM  
EARP  
EN_WATCHDOG  
P1.0  
O
ANAIOD1  
ANAIOD1  
O
positive output to earpiece  
I
DIUP0PES watchdog enable input  
I/O  
I/O  
I/O  
O
H
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISP2DPES general purpose 6.912 MHz output  
ISP2DPES data after clock recovery network  
ISP2DPES R_DATA comparator output  
P1.1  
H
P1.2  
H
GP_CLK7  
DPLL_DATA  
R_SLICED  
VDD5V_1  
P1.3  
L
O
L
O
L
−
−
supply  
positive supply voltage 1 for the +5 V interface  
I/O  
I/O  
I/O  
I/O  
I/O  
−
H
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
P1.4  
H
P1.5  
H
P1.6  
off  
off  
−
ISI8DPES  
ISI8DPES  
supply  
bidirectional 80C51 port pin  
bidirectional 80C51 port pin  
positive supply voltage 2 (+3 V)  
negative buzzer output  
P1.7  
VDD3V_2  
BZM  
O
L
ANAIOD2  
ANAIOD2  
supply  
BZP  
O
L
positive buzzer output  
VSS2  
−
−
negative supply voltage 2  
negative supply voltage 3  
VSS3  
−
−
supply  
P3.0  
I/O  
I/O  
I/O  
I/O  
I/O  
I/O  
H
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
ISQ2CPES bidirectional 80C51 port pin  
P3.1  
H
P3.2  
H
P3.3  
H
P3.4  
H
P3.5  
H
1997 Jul 21  
7
1...45678910...16

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