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N74ALS646-1D PDF预览

N74ALS646-1D

更新时间： 2024-02-06 10:48:07
品牌 Logo 应用领域
飞利浦 - PHILIPS 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
13页 155K
描述
Registered Bus Transceiver, 1-Func, 8-Bit, True Output, TTL, PDSO24

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N74ALS646-1D 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：SOP, SOP24,.4Reach Compliance Code：unknown
风险等级：5.87控制类型：INDEPENDENT CONTROL
计数方向：BIDIRECTIONALJESD-30 代码：R-PDSO-G24
JESD-609代码：e0逻辑集成电路类型：REGISTERED BUS TRANSCEIVER
最大I（ol）：0.048 A位数：8
功能数量：1端子数量：24
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE电源：5 V
最大电源电流（ICC）：88 mAProp。Delay @ Nom-Sup：35 ns
认证状态：Not Qualified子类别：Bus Driver/Transceivers
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：TTL温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
触发器类型：POSITIVE EDGEBase Number Matches：1

N74ALS646-1D 数据手册

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Philips Semiconductors  
Product specification  
74ALS646/74ALS646-1  
74ALS648/74ALS648-1  
Transceiver/register  
74ALS646/646-1  
74ALS648/648-1  
Octal transceiver/register, non-inverting (3-State)  
Octal transceiver/register, inverting (3-State)  
FEATURES  
TYPICAL  
SUPPLY CURRENT  
(TOTAL)  
TYPE  
TYPICAL f  
MAX  
• Combines 74ALS245 and two 74ALS374 type functions in  
one chip  
74ALS646/646-1  
74ALS648/648-1  
140MHz  
140MHz  
48mA  
54mA  
• Independent registers for A and B buses  
• Multiplexed real-time and stored data  
• Choice of non-inverting and inverting data paths  
• 3-State outputs  
ORDERING INFORMATION  
ORDER CODE  
DRAWING  
NUMBER  
COMMERCIAL RANGE  
• The -1 version sink 48mA I within the ±5% V range  
OL  
CC  
V
CC  
= 5V ±10%,  
= 0°C to +70°C  
DESCRIPTION  
T
amb  
DESCRIPTION  
74ALS646N, 74ALS646-1N,  
74ALS648N, 74ALS648-1N  
24-pin plastic DIP  
24-pin plastic SOL  
SOT222-1  
SOT137-1  
The 74ALS646/74ALS646-1 and 74ALS648/74ALS648-1  
transceivers/registers consist of bus transceiver circuits with 3-State  
outputs, D-type flip-flops, and control circuitry arranged for  
multiplexed transmission of data directly from the input bus or the  
internal registers. Data on the A or B bus will be clocked into the  
registers as the appropriate clock pin goes High. Output enable  
(OE) and direction (DIR) and select (SAB, SBA) pins are provided  
for bus management.  
74ALS646D, 74ALS646-1D,  
74ALS648D, 74ALS648-1D  
The 74ALS646-1 and 74ALS648-1 will sink 48mA if the V is  
CC  
limited to 5.0V ±0.25V.  
INPUT AND OUTPUT LOADING AND FAN-OUT TABLE  
74ALS (U.L.)  
LOAD VALUE  
PINS  
DESCRIPTION  
HIGH/LOW  
1.0/1.0  
1.0/1.0  
1.0/1.0  
1.0/1.0  
1.0/1.0  
1.0/1.0  
1.0/1.0  
1.0/1.0  
750/240  
750/480  
HIGH/LOW  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
20µA/0.1mA  
15mA/24mA  
15mA/48mA  
A0 – A7  
B0 – B7  
CPAB  
A inputs  
B inputs  
A-to-B clock input  
B-to-A clock input  
A-to-B select input  
B-to-A select input  
CPBA  
SAB  
SBA  
DIR  
Data flow directional control input  
Output enable input  
OE  
A0 – A7, B0 – B7  
A0 – A7, B0 – B7  
Data outputs  
Data outputs (-1 version)  
NOTE: One (1.0) ALS unit load is defined as: 20µA in the High state and 0.1mA in the Low state.  
2
1991 Feb 08  
853–1408 01670  
1234567...13

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型号 品牌 描述 获取价格 数据表
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