MP7652

更新时间： 2024-01-16 07:49:20

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艾科嘉 - EXAR		转换器数模转换器
页数	文件大小	规格书
16页	181K
描述
4-Channel Voltage Output 15 MHz, Input Bandwidth, 8-Bit Multiplying DACs with 3-Wire Serial Digital Port and Independent References

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MP7652 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP24,.4
针数：	24	Reach Compliance Code：	unknown
风险等级：	5.92	Is Samacsys：	N
最大模拟输出电压：	3 V	转换器类型：	D/A CONVERTER
输入位码：	BINARY	输入格式：	SERIAL
JESD-30 代码：	R-PDSO-G24	JESD-609代码：	e0
长度：	15.4 mm	最大线性误差 (EL)：	0.3906%
标称负供电电压：	-5 V	位数：	8
功能数量：	4	端子数量：	24
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP24,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	电源：	+-5 V
认证状态：	Not Qualified	座面最大高度：	2.65 mm
标称安定时间 (tstl)：	0.275 µs	子类别：	Other Converters
标称供电电压：	5 V	表面贴装：	YES
技术：	BICMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	7.5 mm	Base Number Matches：	1

MP7652 数据手册

MP7652

SDI

(Data In)

CLK

DAC Register

Loaded

OUT

(PRESET = “High” or open)

Figure 1. Serial Data Timing and Loading

SDI

HZ2

HZ1

HIGH Z

SDO

LDCK2

LDSU

CLK

CKLD2

LDCK1

CKLD1

VOUT

+ 1/2 LSB BAND

(PRESET = “High” or open)

Figure 2. Detail Serial Data Input Timing

RST

PRESET

= V

REF

OUT

= 1/2 (V

– V ) + V

REFN REFN

REFP

+ 1/2 LSB ERROR BAND

Figure 3. PRESET Operation

Rev. 1.00

1...3 4 567 8 9...16

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