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MC14557BFEL

更新时间： 2024-01-10 12:01:04
品牌 Logo 应用领域
安森美 - ONSEMI 移位寄存器
页数 文件大小 规格书
8页 172K
描述
1-to-64 Bit Variable Length Shift Register

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MC14557BFEL 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：SOIC包装说明：EIAJ, LEAD FREE, SOIC-16
针数：16Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.66
Is Samacsys：N计数方向：RIGHT
系列：4000/14000/40000JESD-30 代码：R-PDSO-G16
JESD-609代码：e4长度：10.2 mm
逻辑集成电路类型：SERIAL IN SERIAL OUT最大频率@ Nom-Sup：1700000 Hz
湿度敏感等级：3位数：64
功能数量：1端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP16,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260电源：5/15 V
传播延迟（tpd）：600 ns认证状态：Not Qualified
座面最大高度：2.05 mm子类别：Shift Registers
最大供电电压 (Vsup)：18 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40触发器类型：POSITIVE EDGE
宽度：5.275 mm最小 fmax：6.7 MHz
Base Number Matches：1

MC14557BFEL 数据手册

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MC14557B  
SWITCHING CHARACTERISTICS (7.) (C = 50 pF, T = 25 C)  
L
A
(8.)  
Characteristic  
Symbol  
V
DD  
Min  
Typ  
Max  
Unit  
Rise and Fall Time, Q or Q Output  
t
,
ns  
TLH  
t
t
t
, t  
= (1.5 ns/pF) C + 25 ns  
t
THL  
5
10  
15  
—
—
—
100  
50  
40  
200  
100  
80  
TLH THL  
L
, t  
= (0.75 ns/pF) C + 12.5 ns  
TLH THL  
L
, t  
= (0.55 ns/pF) C + 9.5 ns  
L
TLH THL  
Propagation Delay, Clock or CE to Q or Q  
t
t
,
ns  
ns  
PLH  
t
t
t
, t  
= (1.7 ns/pF) C + 215 ns  
5
10  
15  
—
—
—
300  
130  
90  
600  
260  
180  
PLH PHL  
L
PHL  
, t  
= (0.66 ns/pF) C + 97 ns  
PLH PHL  
L
, t  
= (0.5 ns/pF) C + 65 ns  
L
PLH PHL  
Propagation Delay, Reset to Q or Q  
t
,
PLH  
t
t
t
, t  
= (1.7 ns/pF) C + 215 ns  
t
PHL  
5
10  
15  
—
—
—
300  
130  
95  
600  
260  
190  
PLH PHL  
L
, t  
= (0.66 ns/pF) C + 97 ns  
PLH PHL  
L
, t  
= (0.5 ns/pF) C + 70 ns  
L
PLH PHL  
Pulse Width, Clock  
t
5
10  
15  
200  
100  
75  
95  
45  
35  
—
—
—
ns  
ns  
WH(cl)  
Pulse Width, Reset  
t
5
10  
15  
300  
140  
100  
150  
70  
50  
—
—
—
WH(rst)  
Clock Frequency (50% Duty Cycle)  
f
5
10  
15  
—
—
—
3.0  
7.5  
13.0  
1.7  
5.0  
6.7  
MHz  
ns  
cl  
t
su  
Setup Time, A or B to Clock or CE  
Worst case condition: L1 = L2 = L4 = L8 =  
5
10  
15  
700  
290  
145  
350  
130  
85  
—
—
—
L16 = L32 = V (Register Length = 1)  
SS  
Best case condition: L32 = V , L1 through L16 =  
Don’t Care (Any register length from 33 to 64)  
5
10  
15  
400  
165  
60  
45  
5
0
—
—
—
DD  
t
h
ns  
Hold Time, Clock or CE to A or B  
Best case condition: L1 = L2 = L4 = L8 = L16 =  
5
10  
15  
200  
100  
10  
– 150  
– 60  
– 50  
—
—
—
L32 = V (Register Length = 1)  
SS  
Worst case condition: L32 = V , L1 through L16 =  
Don’t Care (Any register length from 33 to 64)  
5
10  
15  
400  
185  
85  
50  
25  
22  
—
—
—
DD  
Rise and Fall Time, Clock  
t ,  
5
10  
15  
—
µs  
ns  
r
t
f
No Limit  
Rise and Fall Time, Reset or CE  
t ,  
5
10  
15  
—
—
—
—
—
—
15  
5
4
r
t
f
Removal Time, Reset to Clock or CE  
t
5
10  
15  
160  
80  
70  
80  
40  
35  
—
—
—
rem  
7. The formulas given are for the typical characteristics only at 25 C.  
8. Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.  
http://onsemi.com  
4
12345678

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