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MC100ELT25DR2 PDF预览

MC100ELT25DR2

更新时间： 2024-01-17 14:31:26
品牌 Logo 应用领域
安森美 - ONSEMI 转换器
页数 文件大小 规格书
4页 70K
描述
Differential ECL to TTL Translator

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MC100ELT25DR2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOIC-8
针数：8Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.31最大延迟：4.1 ns
接口集成电路类型：ECL TO TTL TRANSLATORJESD-30 代码：R-PDSO-G8
JESD-609代码：e0长度：4.9 mm
标称负供电电压：-5 V位数：1
功能数量：1端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：TOTEM-POLE输出锁存器或寄存器：NONE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：240电源：5 V
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Level Translators最大供电电压：5.5 V
最小供电电压：4.5 V标称供电电压：5 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn80Pb20)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：3.9 mm

MC100ELT25DR2 数据手册

 浏览型号MC100ELT25DR2的Datasheet PDF文件第2页浏览型号MC100ELT25DR2的Datasheet PDF文件第3页浏览型号MC100ELT25DR2的Datasheet PDF文件第4页 
The MC10ELT/100ELT25 is a differential ECL to TTL translator.  
Because ECL levels are used a +5V, -5.2V (or -4.5V) and ground are  
required. The small outline 8-lead SOIC package and the single gate of  
the ELT25 makes it ideal for those applications where space,  
performance and low power are at a premium. Because the mature  
MOSAIC 1.5 process is used, low cost can be added to the list of  
features.  
http://onsemi.com  
8
1
The V  
output allows the ELT25 to also be used in a single-ended  
BB  
input mode. In this mode the V  
SO–8  
D SUFFIX  
CASE 751  
output is tied to the IN input for a  
BB  
non-inverting buffer or the IN input for an inverting buffer. If used the  
pin should be bypassed to ground via a 0.01µF capacitor.  
V
BB  
The ELT25 is available in both ECL standards: the 10ELT is  
MARKING DIAGRAM  
compatible with MECL 10H logic levels while the 100ELT is  
compatible with ECL 100K logic levels. For further information  
regarding modeling, refer to AN1596/D “ECLinPS Lite Translator  
ELT Family SPICE I/O Model Kit”.  
• 2.6ns Typical Propagation Delay  
• Internal Input Resistors: Pulldown on D, Pulldown and Pullup on D  
8
1
8
HLT25  
ALYW  
KLT25  
ALYW  
1
L = Wafer Lot  
Y = Year  
H = MC10  
K = MC100  
• Q Output will default LOW with inputs open or at V  
W = Work Week  
A = Assembly Location  
EE  
• Differential ECL Inputs  
• Small Outline SOIC Package  
• 24mA TTL Outputs  
*For additional information, see Application Note  
AND8002/D  
• Flow Through Pinouts  
PIN DESCRIPTION  
• Moisture Sensitivity Level 1, Indefinite Time Out of Drypack.  
For Additional Information, See Application Note AND8003/D  
• Flammability Rating: UL–94 code V–0 @ 1/8”,  
Oxygen Index 28 to 34  
PIN  
FUNCTION  
D
Q
Diff ECL Inputs  
TTL Output  
Positive Supply  
Negative Supply  
Reference Output  
Ground  
V
V
V
CC  
EE  
BB  
• Transistor Count: 135 devices  
LOGIC DIAGRAM AND PINOUT ASSIGNMENT  
GND  
V
1
2
8
7
V
CC  
EE  
TTL  
D0  
Q0  
NC  
ORDERING INFORMATION  
ECL  
Device  
Package  
SO–8  
Shipping  
D0  
BB  
3
4
6
5
MC10ELT25D  
98 Units / Rail  
2500 Units / Reel  
98 Units / Rail  
MC10ELT25DR2  
MC100ELT25D  
MC100ELT25DR2  
SO–8  
SO–8  
V
GND  
SO–8  
2500 Units / Reel  
Semiconductor Components Industries, LLC, 1999  
1
Publication Order Number:  
February, 2000 – Rev. 3  
MC10ELT25/D  
1234

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MC100ELT25DR2 替代型号

型号 品牌 替代类型 描述 数据表
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