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Datasheet > 驱动程序和接口 > 线路驱动器或接收器> MAX9220ETM
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MAX9220ETM

更新时间： 2024-02-07 05:49:46
品牌 Logo 应用领域
美信 - MAXIM 线路驱动器或接收器驱动程序和接口接口集成电路
页数 文件大小 规格书
18页 902K
描述
Programmable DC-Balance 21-Bit Deserializers

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MAX9220ETM 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP,针数：48
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.79
差分输出：NO输入特性：DIFFERENTIAL
接口集成电路类型：LINE RECEIVER接口标准：EIA-644; TIA-644
JESD-30 代码：R-PDSO-G48长度：12.5 mm
功能数量：4端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED认证状态：Not Qualified
接收器位数：4座面最大高度：1.1 mm
最大供电电压：3.6 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：6.1 mmBase Number Matches：1

MAX9220ETM 数据手册

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Programmable DC-Balance  
21-Bit Deserializers  
90%  
90%  
RxOUT_ OR  
RxCLK OUT  
10%  
10%  
RxOUT_ OR  
RxCLK OUT  
8pF  
CLHT  
CHLT  
Figure 3. Output Load and Transition Times  
IDEAL SERIAL BIT TIME  
1.3V  
1.1V  
RxCLK IN  
V
= 0  
ID  
RCCD  
1.5V  
RxCLK OUT  
RSKM  
RSKM  
IDEAL  
IDEAL  
Figure 6a. Rising-Edge Clock-IN to Clock-OUT Delay  
MIN  
MAX  
INTERNAL STROBE  
+
RxCLK IN  
Figure 4. LVDS Receiver Input Skew Margin  
V
= 0  
ID  
-
RCCD  
RCIP  
1.5V  
RxCLK OUT  
RxCLK OUT  
2.0V  
2.0V  
2.0V  
0.8V  
0.8V  
RCOL  
RCOH  
RHRC  
2.0V  
Figure 6b. Falling-Edge Clock-IN to Clock-OUT Delay  
RSRC  
2.0V  
0.8V  
RxOUT_  
0.8V  
2V  
Figure 5a. Rising-Edge Output Setup/Hold and High/Low Times  
PWRDWN  
3V  
RCIP  
V
CC  
RPLLS  
2.0V  
0.8V  
2.0V  
RxCLK OUT  
RxOUT_  
0.8V  
0.8V  
RxCLK IN  
RCOH  
RSRC  
RCOL  
RHRC  
2.0V  
0.8V  
2.0V  
0.8V  
RxCLK OUT  
HIGH-Z  
Figure 5b. Falling-Edge Output Setup/Hold and High/Low Times  
_______________________________________________________________________________________  
Figure 7. Phase-Locked Loop Set Time  
8
1...567891011...18

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型号 品牌 获取价格 描述 数据表
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 		Programmable DC-Balance 21-Bit Deserializers
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 		暂无描述
MAX9220EUM+TD MAXIM

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