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MAX7349AWG PDF预览

MAX7349AWG

更新时间： 2024-02-05 04:08:34
品牌 Logo 应用领域
美信 - MAXIM 开关控制器
页数 文件大小 规格书
29页 348K
描述
Microprocessor Circuit, BICMOS, PDSO24, 0.300 INCH, MS-013AD, SOIC-24

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MAX7349AWG 技术参数

是否Rohs认证： 不符合生命周期：Active
Reach Compliance Code：not_compliant风险等级：5.88
JESD-30 代码：R-PDSO-G24JESD-609代码：e0
端子数量：24最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP24,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
电源：2.5/3.3 V认证状态：Not Qualified
子类别：Parallel IO Port最大压摆率：0.1 mA
表面贴装：YES技术：BICMOS
温度等级：AUTOMOTIVE端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUALBase Number Matches：1

MAX7349AWG 数据手册

 浏览型号MAX7349AWG的Datasheet PDF文件第4页浏览型号MAX7349AWG的Datasheet PDF文件第5页浏览型号MAX7349AWG的Datasheet PDF文件第6页浏览型号MAX7349AWG的Datasheet PDF文件第8页浏览型号MAX7349AWG的Datasheet PDF文件第9页浏览型号MAX7349AWG的Datasheet PDF文件第10页 
2-Wire Interfaced Low-EMI Key Switch  
and Sounder Controllers  
8/MAX7349  
*MAX7348 AND  
MAX7349 ONLY.  
**MAX7349 ONLY.  
KEY  
0
KEY  
8
KEY  
16  
KEY  
24  
KEY  
32  
KEY  
40  
KEY  
48  
KEY  
56  
COL7/PORT7**  
COL6/PORT6**  
COL5/PORT5**  
COL4/PORT4*  
COL3/PORT3*  
COL2/PORT2  
COL1  
KEY  
1
KEY  
9
KEY  
17  
KEY  
25  
KEY  
33  
KEY  
41  
KEY  
49  
KEY  
57  
KEY  
2
KEY  
10  
KEY  
18  
KEY  
26  
KEY  
34  
KEY  
42  
KEY  
50  
KEY  
58  
COL0  
ROW0  
ROW1  
ROW2  
KEY  
3
KEY  
11  
KEY  
19  
KEY  
27  
KEY  
35  
KEY  
43  
KEY  
51  
KEY  
59  
ROW3  
ROW4  
ROW5  
ROW6  
KEY  
4
KEY  
12  
KEY  
20  
KEY  
28  
KEY  
36  
KEY  
44  
KEY  
52  
KEY  
60  
ROW7  
KEY  
5
KEY  
13  
KEY  
21  
KEY  
29  
KEY  
37  
KEY  
45  
KEY  
53  
KEY  
61  
KEY  
6
KEY  
14  
KEY  
22  
KEY  
30  
KEY  
38  
KEY  
46  
KEY  
54  
KEY  
62  
KEY  
7
KEY  
15  
KEY  
23  
KEY  
31  
KEY  
39  
KEY  
47  
KEY  
55  
KEY  
63  
Figure 1. Keys Order  
STOP (P) condition by transitioning SDA from low to  
high while SCL is high. The bus is then free for another  
transmission.  
byte of data. Thus, each byte transferred effectively  
requires 9 bits. The master generates the 9th clock  
pulse, and the recipient pulls down SDA during the  
acknowledge clock pulse, so the SDA line is stable low  
during the high period of the clock pulse. When the  
master is transmitting to the MAX7347/MAX7348/  
MAX7349, the MAX7347/MAX7348/MAX7349 generate  
the acknowledge bit because the MAX7347/MAX7348/  
MAX7349 are the recipients. When the MAX7347/  
MAX7348/MAX7349 are transmitting to the master, the  
master generates the acknowledge bit because the  
master is the recipient.  
Bit Transfer  
One data bit is transferred during each clock pulse  
(Figure 4). The data on SDA must remain stable while  
SCL is high.  
Acknowledge  
The acknowledge bit is a clocked 9th bit (Figure 5),  
which the recipient uses to handshake receipt of each  
_______________________________________________________________________________________  
7
1...45678910...29

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