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MAX6729KAMRD3-T

更新时间： 2024-02-02 17:24:50
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美信 - MAXIM 监控
页数 文件大小 规格书
19页 304K
描述
Dual/Triple Ultra-Low-Voltage SOT23 µ.P Supervisory Circuits

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MAX6729KAMRD3-T 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：LSSOP,针数：8
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.54
可调阈值：YES模拟集成电路 - 其他类型：POWER SUPPLY MANAGEMENT CIRCUIT
JESD-30 代码：R-PDSO-G8JESD-609代码：e3
长度：2.9 mm信道数量：3
功能数量：1端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, LOW PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.45 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：0.8 V表面贴装：YES
技术：BICMOS温度等级：INDUSTRIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：1.625 mm

MAX6729KAMRD3-T 数据手册

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Dual/Triple Ultra-Low-Voltage SOT23 µP  
Supervisory Circuits  
ELECTRICAL CHARACTERISTICS (continued)  
(V 1 = V 2 = 0.8V to 5.5V, GND = 0, T = -40°C to +85°C, unless otherwise noted. Typical values are at T = +25°C.) (Note 1)  
CC  
CC  
A
A
PARAMETER  
SYMBOL  
CONDITIONS  
1 = (V 1+ 100mV) to (V 1 - 100mV) or  
MIN  
TYP  
MAX  
UNITS  
V
CC  
V
CC  
TH  
TH  
V
to Reset Output Delay  
t
20  
µs  
CC  
RD  
2 = (V 2 + 75mV) to (V 2 - 75mV)  
TH  
TH  
D1  
D2  
D3  
D5  
D6  
D4  
1.1  
8.8  
1.65  
13.2  
210  
2.2  
17.6  
280  
140  
280  
560  
1120  
Reset Timeout Period  
t
ms  
RP  
420  
560  
840  
1120  
2240  
1680  
ADJUSTABLE RESET COMPARATOR INPUT (MAX6719/MAX6720/MAX6723–MAX6727)  
RSTIN Input Threshold  
RSTIN Input Current  
V
611  
-25  
626.5  
642  
+25  
mV  
nA  
RSTIN  
RSTIN  
I
RSTIN Hysteresis  
3
mV  
µs  
RSTIN to Reset Output Delay  
t
V
to (V - 30mV)  
RSTIN  
22  
RSTIND  
RSTIN  
POWER-FAIL INPUT (MAX6728/MAX6729)  
PFI Input Threshold  
PFI Input Current  
PFI Hysteresis  
V
611  
-25  
626.5  
642  
+25  
mV  
nA  
mV  
µs  
PFI  
PFI  
I
V
3
2
PFH  
DPF  
PFI to PFO Delay  
t
(V + 30mV) to (V - 30mV)  
PFI PFI  
MANUAL RESET INPUT (MAX6715–MAX6722/MAX6725–MAX6729)  
V
0.3 ✕ V  
1
CC  
IL  
MR Input Voltage  
V
V
0.7 ✕ V  
1
CC  
IH  
MR Minimum Pulse Width  
MR Glitch Rejection  
MR to Reset Delay  
1
µs  
ns  
ns  
kΩ  
100  
200  
50  
t
MR  
MR Pullup Resistance  
25  
35  
80  
WATCHDOG INPUT (MAX6721–MAX6729)  
First watchdog period after reset timeout  
period  
54  
72  
Watchdog Timeout Period  
t
s
WD  
Normal mode  
(Note 2)  
1.12  
50  
1.68  
2.24  
WDI Pulse Width  
WDI Input Voltage  
WDI Input Current  
t
ns  
V
WDI  
V
0.3 ✕ V  
1
CC  
IL  
V
0.7 ✕ V  
1
CC  
IH  
I
WDI = 0 or V  
1
CC  
-1  
+1  
µA  
WDI  
_______________________________________________________________________________________  
3
1234567...19

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