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M54HC112K PDF预览

M54HC112K

更新时间： 2024-01-25 05:17:14
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 触发器锁存器逻辑集成电路
页数 文件大小 规格书
11页 257K
描述
RAD-HARD DUAL J-K FLIP FLOP WITH PRESET AND CLEAR

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M54HC112K 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DFP包装说明：DFP, FL16,.3
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.91
Is Samacsys：N系列：HC/UH
JESD-30 代码：R-CDFP-F16JESD-609代码：e0
长度：9.94 mm负载电容（CL）：50 pF
逻辑集成电路类型：J-K FLIP-FLOP最大频率@ Nom-Sup：27000000 Hz
最大I（ol）：0.004 A位数：2
功能数量：2端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：DFP封装等效代码：FL16,.3
封装形状：RECTANGULAR封装形式：FLATPACK
峰值回流温度（摄氏度）：NOT SPECIFIED电源：2/6 V
Prop。Delay @ Nom-Sup：38 ns传播延迟（tpd）：190 ns
认证状态：Not Qualified筛选级别：ESCC9000
座面最大高度：2.38 mm子类别：FF/Latches
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：4.5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED总剂量：50k Rad(Si) V
触发器类型：NEGATIVE EDGE宽度：6.91 mm
最小 fmax：32 MHzBase Number Matches：1

M54HC112K 数据手册

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M54HC112  
RAD-HARD DUAL J-K FLIP FLOP WITH PRESET AND CLEAR  
■
■
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■
■
■
HIGH SPEED:  
= 79MHz (TYP.) at V = 6V  
f
MAX  
CC  
LOW POWER DISSIPATION:  
=2µA(MAX.) at T =25°C  
I
CC  
A
HIGH NOISE IMMUNITY:  
= V = 28% V (MIN.)  
V
NIH  
NIL  
CC  
DILC-16  
FPC-16  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 4mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
t
t
ORDER CODES  
PACKAGE  
PLH  
PHL  
WIDE OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
FM  
EM  
V
CC  
DILC  
FPC  
M54HC112D  
M54HC112K  
M54HC112D1  
M54HC112K1  
PIN AND FUNCTION COMPATIBLE WITH  
54 SERIES 112  
■
■
SPACE GRADE-1: ESA SCC QUALIFIED  
50 krad QUALIFIED, 100 krad AVAILABLE ON  
REQUEST  
NO SEL UNDER HIGH LET HEAVY IONS  
IRRADIATION  
individual J, K, clock, and asynchronous set and  
clear inputs for each flip-flop. When the clock goes  
high, the inputs are enabled and data will be  
accepted. The logic level of the J and K inputs  
may be allowed to change when the clock pulse is  
high and the bistable will function as shown in the  
truth table. Input data is transferred to the input on  
the negative going edge of the clock pulse.  
All inputs are equipped with protection circuits  
against static discharge and transient excess  
voltage.  
■
■
DEVICE FULLY COMPLIANT WITH  
SCC-9203-051  
DESCRIPTION  
The M54HC112 is an high speed CMOS DUAL  
J-K FLIP-FLOP WITH PRESET AND CLEAR  
2
fabricated with silicon gate C MOS technology.  
The M54HC112 dual JK flip-flop features  
PIN CONNECTION  
March 2004  
1/11  
1234567...11

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M54HC112K 替代型号

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