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M390S3253CTU-C1H PDF预览

M390S3253CTU-C1H

更新时间： 2024-02-28 13:36:04
品牌 Logo 应用领域
三星 - SAMSUNG 时钟动态存储器内存集成电路
页数 文件大小 规格书
12页 188K
描述
Synchronous DRAM Module, 32MX72, 6ns, CMOS, DIMM-168

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M390S3253CTU-C1H 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIMM包装说明：DIMM, DIMM168
针数：168Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.32.00.36
风险等级：5.92访问模式：SINGLE BANK PAGE BURST
最长访问时间：6 ns其他特性：AUTO/SELF REFRESH
最大时钟频率 (fCLK)：100 MHzI/O 类型：COMMON
JESD-30 代码：R-XDMA-N168内存密度：2415919104 bit
内存集成电路类型：SYNCHRONOUS DRAM MODULE内存宽度：72
湿度敏感等级：1功能数量：1
端口数量：1端子数量：168
字数：33554432 words字数代码：32000000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：32MX72
输出特性：3-STATE封装主体材料：UNSPECIFIED
封装代码：DIMM封装等效代码：DIMM168
封装形状：RECTANGULAR封装形式：MICROELECTRONIC ASSEMBLY
峰值回流温度（摄氏度）：225电源：3.3 V
认证状态：Not Qualified刷新周期：8192
自我刷新：YES最大待机电流：0.02 A
子类别：DRAMs最大压摆率：2.21 mA
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：NO
技术：CMOS温度等级：COMMERCIAL
端子形式：NO LEAD端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
Base Number Matches：1

M390S3253CTU-C1H 数据手册

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M390S3253CTU  
PC133/PC100 Low Profile Registered DIMM  
M390S3253CTU SDRAM DIMM  
32Mx72 SDRAM DIMM with PLL & Register based on 32Mx8, 4Banks 8K Ref., 3.3V Synchronous DRAMs with SPD  
FEATURE  
GENERAL DESCRIPTION  
• Performance range  
The Samsung M390S3253CTU is a 32M bit x 72 Synchronous  
Dynamic RAM high density memory module. The Samsung  
M390S3253CTU consists of nine CMOS 32Mx8 bit Synchro-  
nous DRAMs in TSOP-II 400mil packages, two 18-bits Drive  
ICs for input control signal and one 2K EEPROM in 8-pin  
TSSOP package for Serial Presence Detect on a 168pin glass-  
epoxy substrate. Three 0.1uF decoupling capacitors are  
mounted on the printed circuit board in parallel for each  
SDRAM. The M390S3253CTU is a Dual In-line Memory Module  
and is intented for mounting into 168-pin edge connector sock-  
ets.  
Part No.  
Max Freq. (Speed)  
133MHz (7.5ns @ CL=2)  
133MHz (7.5ns @ CL=3)  
100MHz (10ns @ CL=2)  
100MHz (10ns @ CL=3)  
M390S3253CTU-C7C  
M390S3253CTU-C7A  
M390S3253CTU-C1H  
M390S3253CTU-C1L  
• Burst mode operation  
• Auto & self refresh capability (8192Cycles/64ms)  
• LVTTL compatible inputs and outputs  
• Single 3.3V ± 0.3V power supply  
• MRS cycle with address key programs  
Latency (Access from column address)  
Burst length (1, 2, 4, 8 & Full page)  
Synchronous design allows precise cycle control with the use  
of system clock. I/O transactions are possible on every clock  
cycle. Range of operating frequencies, programmable latencies  
allows the same device to be useful for a variety of high band-  
width, high performance memory system applications.  
Data scramble (Sequential & Interleave)  
• All inputs are sampled at the positive going edge of the  
system clock  
• Serial presence detect with EEPROM  
• PCB : Height (1,200mil), double sided component  
PIN CONFIGURATIONS (Front side/back side)  
PIN NAMES  
Pin  
Pin Front Pin Front  
Front Pin Back Pin Back Pin Back  
Pin Name  
A0 ~ A12  
BA0 ~ BA1  
DQ0 ~ DQ63  
CB0 ~ CB7  
CLK0  
Function  
Address input (Multiplexed)  
Select bank  
57  
58  
59  
60  
61  
62  
63  
64  
65  
66  
67  
68  
69  
70  
71  
1
2
3
4
5
VSS  
29 DQM1  
DQ18 85  
VSS  
113 DQM5 141 DQ50  
DQ0 30  
DQ1 31  
DQ2 32  
DQ3 33  
CS0  
DU  
VSS  
A0  
DQ19 86 DQ32 114 *CS1 142 DQ51  
Data input/output  
Check bit (Data-in/data-out)  
Clock input  
VDD  
87 DQ33 115 RAS 143  
VDD  
DQ20 88 DQ34 116  
NC 89 DQ35 117  
*VREF 90 118  
*CKE1 91 DQ36 119  
92 DQ37 120  
DQ21 93 DQ38 121  
VSS  
A1  
A3  
A5  
A7  
A9  
144 DQ52  
145  
NC  
6
VDD  
34  
A2  
VDD  
146 *VREF  
147 REGE  
CKE0  
Clock enable input  
Chip select input  
Row address strobe  
Colume address strobe  
Write enable  
7
8
9
DQ4 35  
DQ5 36  
DQ6 37  
A4  
A6  
A8  
VSS  
148  
VSS  
CS0, CS2  
RAS  
149 DQ53  
10  
11  
12  
13  
DQ7 38 A10/AP  
DQ22 94 DQ39 122 BA0 150 DQ54  
CAS  
DQ8 39  
40  
DQ9 41  
BA1  
VDD  
VDD  
DQ23 95 DQ40 123  
96 124  
A11  
VDD  
151 DQ55  
152  
WE  
VSS  
VSS  
VSS  
VSS  
DQ24 97 DQ41 125 *CLK1 153 DQ56  
DQM0 ~ 7  
VDD  
DQM  
14 DQ10 42 CLK0  
DQ25 98 DQ42 126  
DQ26 99 DQ43 127  
A12  
VSS  
154 DQ57  
155 DQ58  
Power supply (3.3V)  
Ground  
15 DQ11 43  
16 DQ12 44  
17 DQ13 45  
VSS  
DU  
CS2  
VSS  
72 DQ27 100 DQ44 128 CKE0 156 DQ59  
73  
74  
75  
76  
77  
78  
79  
80  
81  
82  
VDD 101 DQ45 129 *CS3 157  
VDD  
*VREF  
Power supply for reference  
Register enable  
Serial data I/O  
18  
VDD  
46 DQM2  
DQ28 102 130 DQM6 158 DQ60  
VDD  
REGE  
SDA  
19 DQ14 47 DQM3  
DQ29 103 DQ46 131 DQM7 159 DQ61  
DQ30 104 DQ47 132 *A13 160 DQ62  
20 DQ15 48  
DU  
VDD  
NC  
SCL  
Serial clock  
21  
22  
23  
24  
25  
26  
27  
CB0  
CB1  
VSS  
NC  
NC  
VDD  
WE  
49  
50  
51  
52  
53  
54  
DQ31 105 CB4 133  
VDD  
NC  
NC  
161 DQ63  
162  
163 *CLK3  
NC  
137 CB7 165 **SA0  
138 166 **SA1  
VSS  
106 CB5 134  
VSS  
SA0 ~ 2  
DU  
Address in EEPROM  
Don¢t use  
NC  
*CLK2 107  
VSS  
NC  
NC  
135  
CB2  
CB3  
VSS  
NC  
NC  
108  
109  
136 CB6 164  
NC  
No connection  
**SDA 110  
VDD  
VSS  
*
These pins are not used in this module.  
** These pins should be NC in the system  
55 DQ16 83 **SCL 111 CAS 139 DQ48 167 **SA2  
84  
28 DQM0 56 DQ17  
VDD 112 DQM4 140 DQ49 168  
VDD  
which does not support SPD.  
SAMSUNG ELECTRONICS CO., Ltd. reserves the right to change products and specifications without notice.  
Rev. 0.1 Sept. 2001  
1234567...12

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