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LTC1750IFW#TRPBF

更新时间： 2024-02-14 09:44:11
品牌 Logo 应用领域
凌特 - Linear /
页数 文件大小 规格书
20页 277K
描述
LTC1750 - 14-Bit, 80Msps Wide Bandwidth ADC; Package: TSSOP; Pins: 48; Temperature Range: -40°C to 85°C

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LTC1750IFW#TRPBF 技术参数

是否Rohs认证：符合生命周期：Transferred
零件包装代码：TSSOP包装说明：TSSOP,
针数：48Reach Compliance Code：compliant
ECCN代码：3A991.C.3HTS代码：8542.39.00.01
风险等级：5.34Is Samacsys：N
转换器类型：ADC, PROPRIETARY METHODJESD-30 代码：R-PDSO-G48
JESD-609代码：e3长度：12.5 mm
最大线性误差 (EL)：0.0183%湿度敏感等级：1
模拟输入通道数量：1位数：14
功能数量：1端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
输出位码：OFFSET BINARY, 2'S COMPLEMENT BINARY输出格式：PARALLEL, WORD
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
采样速率：80 MHz采样并保持/跟踪并保持：SAMPLE
座面最大高度：1.2 mm标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：6.1 mmBase Number Matches：1

LTC1750IFW#TRPBF 数据手册

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LTC1750  
14-Bit, 80Msps  
Wide Bandwidth ADC  
U
FEATURES  
DESCRIPTIO  
■
Sample Rate: 80Msps  
The LTC®1750 is an 80Msps, 14-bit A/D converter de-  
signed for digitizing wide dynamic range signals up to  
frequencies of 500MHz. The input range of the ADC can be  
optimized with the on-chip PGA sample-and-hold circuit  
and flexible reference circuitry.  
■
500MHz Full Power Bandwidth S/H  
■
Direct IF Sampling Up to 500MHz  
■
PGA Front End (2.25VP-P or 1.35VP-P Input Range)  
75.5dB SNR and 90dB SFDR (PGA = 0)  
73dB SNR and 90dB SFDR (PGA = 1)  
■
■
The LTC1750 has a highly linear sample-and-hold circuit  
with a bandwidth of 500MHz. The SFDR is 82dB with an  
input frequency of 250MHz. Ultralow jitter of 0.12psRMS  
allows undersampling of IF frequencies with minimal  
degradation in SNR. DC specs include ±3LSB INL and no  
missing codes.  
■
No Missing Codes  
Single 5V Supply  
Power Dissipation: 1.45W  
■
■
■
Two Pin Selectable Reference Values  
■
Two’s Complement or Offset Binary Outputs  
■
Out-of-Range Indicator  
■
■
■
The digital interface is compatible with 5V, 3V, 2V and  
LVDS logic systems. The ENC and ENC inputs may be  
driven differentially from PECL, GTL and other low swing  
logic families or from single-ended TTL or CMOS. The low  
noise, high gain ENC and ENC inputs may also be driven  
by a sinusoidal signal without degrading performance. A  
separate output power supply can be operated from 0.5V  
to 5V, making it easy to connect directly to any low voltage  
DSPs or FIFOs.  
Data Ready Output Clock  
Pin-for-Pin Family  
48-Pin TSSOP Package  
U
APPLICATIO S  
■
Telecommunications  
■
Receivers  
■
Cellular Base Stations  
■
Spectrum Analysis  
The 48-pin TSSOP package with a flow-through pinout  
simplifies the board layout.  
■
Imaging Systems  
■
MRI  
■
, LTC and LT are registered trademarks of Linear Technology Corporation.  
Tomography  
W
BLOCK DIAGRA  
80Msps, 14-Bit ADC with a 2.25V Differential Input Range  
OV  
DD  
PGA  
0.5V TO 5V  
0.1µF  
0.1µF  
+
A
OF  
D13  
IN  
CORRECTION  
LOGIC AND  
SHIFT  
±1.125V  
14  
S/H  
CIRCUIT  
14-BIT  
PIPELINED ADC  
OUTPUT  
LATCHES  
•
•
•
DIFFERENTIAL  
–
A
ANALOG INPUT  
IN  
D0  
CLKOUT  
REGISTER  
SENSE  
OGND  
BUFFER  
V
DD  
5V  
1µF  
RANGE  
SELECT  
1µF  
1µF  
DIFF AMP  
V
CM  
GND  
2V  
REF  
CONTROL LOGIC  
4.7µF  
1750 BD  
REFLB REFHA  
4.7µF  
REFLA REFHB  
ENC  
ENC MSBINV  
0.1µF  
1µF  
0.1µF  
1µF  
DIFFERENTIAL  
ENCODE INPUT  
1750f  
1
1234567...20

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