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IDT71V3579S75PFGI

更新时间： 2024-02-05 04:35:45
品牌 Logo 应用领域
艾迪悌 - IDT 计数器静态存储器
页数 文件大小 规格书
22页 522K
描述
128K X 36, 256K X 18 3.3V Synchronous SRAMs 3.3V I/O, Flow-Through Outputs Burst Counter, Single Cycle Deselect

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IDT71V3579S75PFGI 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：BGA包装说明：FBGA-165
针数：165Reach Compliance Code：unknown
ECCN代码：3A991.B.2.AHTS代码：8542.32.00.41
风险等级：5.74最长访问时间：7.5 ns
其他特性：FLOW-THROUGH ARCHITECTURE最大时钟频率 (fCLK)：117 MHz
I/O 类型：COMMONJESD-30 代码：R-PBGA-B165
JESD-609代码：e1长度：15 mm
内存密度：4718592 bit内存集成电路类型：CACHE SRAM
内存宽度：18湿度敏感等级：3
功能数量：1端子数量：165
字数：262144 words字数代码：256000
工作模式：SYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：256KX18
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：TBGA封装等效代码：BGA165,11X15,40
封装形状：RECTANGULAR封装形式：GRID ARRAY, THIN PROFILE
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
座面最大高度：1.2 mm最大待机电流：0.03 A
最小待机电流：3.14 V子类别：SRAMs
最大压摆率：0.255 mA最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：30
宽度：13 mmBase Number Matches：1

IDT71V3579S75PFGI 数据手册

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IDT71V3577, IDT71V3579, 128K x 36, 256K x 18, 3.3V Synchronous SRAMs with  
3.3V I/O, Flow-Through Outputs, Burst Counter, Single Cycle Deselect  
Commercial and Industrial Temperature Ranges  
Pin Configuration – 128K x 36, 119 BGA  
1
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6
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A
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A
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I/O  
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V
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ADV  
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CLK  
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P4  
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0
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NC  
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5
A
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V
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(3)  
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A
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NC  
A
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ZZ  
(2)  
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(2,4)  
NC/TDO  
DDQ  
V
DDQ  
V
NC/TMS  
NC/TDI  
NC/TCK  
NC/TRST  
U
5280 drw 02c  
Top View  
Pin Configuration – 256K x 18, 119 BGA  
1
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A
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A
B
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NC  
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SS  
SS  
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NC  
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CE  
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NC  
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I/O  
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BW2  
ADV  
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NC  
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I/O  
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I/O  
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NC  
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DD  
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NC  
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I/O  
SS  
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K
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NC  
CLK  
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SS  
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I/O  
1
I/O  
BW1  
NC  
NC  
DDQ  
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SS  
V
SS  
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DDQ  
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I/O  
NC  
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NC  
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I/O  
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DD  
V
SS  
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A
A
NC  
LBO  
ZZ(3)  
10  
A
15  
A
14  
A
11  
A
NC  
NC/TDO(2)  
DDQ  
V
NC/TMS(2) NC/TDI(2) NC/TCK(2)  
NC/TRST(2,4)  
U
V
5280 drw 02d  
,
Top View  
NOTES:  
1. R5 does not have to be directly connected to VSS as long as the input voltage is < VIL.  
2. These pins are NC for the "S" version or the JTAG signal listed for the "SA" version. Note: If NC, these pins can either be tied to VSS, VDD or left floating.  
3. T7 can be left unconnected and the device will always remain in active mode.  
4. TRST is offered as an optional JTAG Reset if required in the application. If not needed, can be left floating and will internally be pulled to VDD.  
6.42  
7
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与IDT71V3579S75PFGI相关器件

型号 品牌 描述 获取价格 数据表
IDT71V3579S80BGG IDT 128K X 36, 256K X 18 3.3V Synchronous SRAMs 3.3V I/O, Flow-Through Outputs Burst Counter,

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