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IDT709379L9PF8

更新时间： 2024-10-01 21:20:59

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艾迪悌 - IDT		时钟静态存储器内存集成电路
页数	文件大小	规格书
15页	187K
描述
Dual-Port SRAM, 32KX18, 9ns, CMOS, PQFP100, TQFP-100

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IDT709379L9PF8 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	TQFP-100	针数：	100
Reach Compliance Code：	not_compliant	ECCN代码：	3A991.B.2.B
HTS代码：	8542.32.00.41	风险等级：	5.55
最长访问时间：	9 ns	最大时钟频率 (fCLK)：	66 MHz
I/O 类型：	COMMON	JESD-30 代码：	S-PQFP-G100
JESD-609代码：	e0	长度：	14 mm
内存密度：	589824 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	18	湿度敏感等级：	3
功能数量：	1	端口数量：	2
端子数量：	100	字数：	32768 words
字数代码：	32000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	32KX18	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFQFP
封装等效代码：	QFP100,.63SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	240	电源：	5 V
认证状态：	Not Qualified	座面最大高度：	1.6 mm
最大待机电流：	0.003 A	最小待机电流：	4.5 V
子类别：	SRAMs	最大压摆率：	0.4 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	20	宽度：	14 mm
Base Number Matches：	1

IDT709379L9PF8 数据手册

HIGH-SPEED 32K x 18

IDT709379L

SYNCHRONOUS PIPELINED

DUAL-PORT STATIC RAM

Features

◆

True Dual-Ported memory cells which allow simultaneous

access of the same memory location

High-speed clock to data access

– Commercial: 7.5/9/12ns (max.)

Low-power operation

Full synchronous operation on both ports

– 4ns setup to clock and 0ns hold on all control, data, and

address inputs

◆

– Data input, address, and control registers

– Fast 7.5ns clock to data out in the Pipelined output mode

– Self-timed write allows fast cycle time

– IDT709379L

Active: 1.2W (typ.)

Standby: 2.5mW (typ.)

– 12ns cycle time, 83MHz operation in Pipelined output mode

Separate upper-byte and lower-byte controls for

multiplexed bus and bus matching compatibility

TTL- compatible, single 5V (±10%) power supply

Industrial temperature range (–40°C to +85°C) is

available for selected speeds

◆

Flow-Through or Pipelined output mode on either Port via

the FT/PIPE pins

Counter enable and reset features

Dual chip enables allow for depth expansion without

additional logic

◆

Available in a 100-pin Thin Quad Flatpack (TQFP) package

Functional Block Diagram

R/WL

UBL

R/WR

UBR

CE0L

CE1L

CE0R

CE^1R

0/1

LBL

LBR

OEL

OER

1b 0b

0a 1a

0b 1b

1a 0a

FT/PIPEL

0/1

FT/PIPER

I/O9L-I/O17L

I/O0L-I/O8L

I/O9R-I/O17R

I/O0R-I/O8R

I/O

Control

I/O

Control

A14R

A14L

Counter/

Address

Reg.

Counter/

Address

Reg.

MEMORY

ARRAY

A0R

A0L

CLK^R

ADSR

CLKL

ADSL

CNTENL

CNTENR

CNTRSTL

CNTRSTR

4845 drw 01

JANUARY 2001

DSC-4845/3

12 3 4 5 6 7...15

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