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GM76C256CLLET-70

更新时间： 2024-01-08 22:13:25
品牌 Logo 应用领域
其他 - ETC 内存集成电路静态存储器光电二极管
页数 文件大小 规格书
10页 81K
描述
x8 SRAM

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GM76C256CLLET-70 技术参数

是否Rohs认证：不符合生命周期：Transferred
Reach Compliance Code：unknown风险等级：5.78
Is Samacsys：N最长访问时间：70 ns
I/O 类型：COMMONJESD-30 代码：R-PDSO-G28
JESD-609代码：e0内存密度：262144 bit
内存集成电路类型：STANDARD SRAM内存宽度：8
端子数量：28字数：32768 words
字数代码：32000工作模式：ASYNCHRONOUS
最高工作温度：85 °C最低工作温度：-25 °C
组织：32KX8输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP28,.53,22封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH并行/串行：PARALLEL
电源：5 V认证状态：Not Qualified
最大待机电流：0.00001 A最小待机电流：2 V
子类别：SRAMs最大压摆率：0.07 mA
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：OTHER
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.55 mm端子位置：DUAL
Base Number Matches：1

GM76C256CLLET-70 数据手册

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LG Semicon  
GM76C256CL/LL  
AC Operating Characteristics (VCC=5.0V + 0.5V , TA = -25 ~ 85C)  
Read Cycle  
GM76C256C-55  
GM76C256C-70  
Condi-  
tions  
Unit  
Symbol  
Parameter  
Min  
55  
-
Max  
-
Min  
70  
-
Max  
-
t
t
t
t
t
t
t
t
t
RC  
Read Cycle Time  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
AA  
Address Access Time  
55  
55  
25  
-
70  
70  
30  
-
ACS  
OE  
Chip Select Access Time  
*1  
*2  
-
-
Output Enable Access Time  
Output Hold Time  
-
-
OH  
10  
10  
5
10  
10  
5
CLZ  
OLZ  
CHZ  
OHZ  
Chip Selection to Output in Low-Z  
Output Disable to Output in Low-Z  
Chip Deselection to Output in High-Z  
Output Disable to Output in High-Z  
-
-
-
-
0
20  
20  
0
25  
25  
0
0
Write Cycle  
GM76C256C-55  
GM76C256C-70  
Condi-  
tions  
Unit  
Symbol  
Parameter  
Min  
55  
45  
45  
0
Max  
Min  
70  
60  
60  
0
Max  
t
t
t
t
t
t
t
t
t
t
WC  
CW  
AW  
AS  
Write Cycle Time  
-
-
-
-
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
Chip Select to End of Write  
Address Set-up Time to End of Write  
Address Set-up Time  
-
-
-
-
*1  
*2  
WP  
WR  
DW  
DH  
Write Pulse Width  
40  
0
-
50  
0
-
Write Recovery Time  
-
-
Data to Write Time Overlap  
Data Hold Time  
25  
0
-
30  
0
-
-
-
WHZ  
OW  
Write to Output in High-Z  
Output Active from End of Write  
0
20  
-
0
25  
-
5
5
*1 Test Conditions.  
*2 Test Conditions.  
1. Input pulse level : 0.6V to 2.4V  
2. tr = tf = 5ns  
1. Input pulse level : 0.6V to 2.4V  
2. tr = tf = 5ns  
3. Input/output timing reference level : 1.5V  
4. Output load CL = 100pF + 1TTL Load  
3. Input timing reference level : 1.5V  
4. Output timing reference level :  
+/-200mV (the level displacement from  
stable output voltage level)  
5. Output load CL = 5pF + 1TTL Load  
36  
1234567...10

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与GM76C256CLLET-70相关器件

型号 品牌 描述 获取价格 数据表
GM76C256CLLET-85 HYNIX Standard SRAM, 32KX8, 85ns, CMOS, PDSO28, 8 X 13.40 MM, TSOP1-28

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