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EBE10RD4ABFA-4A

更新时间： 2024-02-29 16:46:26
品牌 Logo 应用领域
尔必达 - ELPIDA 时钟动态存储器双倍数据速率内存集成电路
页数 文件大小 规格书
22页 171K
描述
DDR DRAM Module, 128MX72, 0.6ns, CMOS, DIMM-240

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EBE10RD4ABFA-4A 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIMM包装说明：DIMM, DIMM240,40
针数：240Reach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.32.00.36
风险等级：5.92访问模式：SINGLE BANK PAGE BURST
最长访问时间：0.6 ns其他特性：AUTO/SELF REFRESH
最大时钟频率 (fCLK)：200 MHzI/O 类型：COMMON
JESD-30 代码：R-XDMA-N240内存密度：9663676416 bit
内存集成电路类型：DDR DRAM MODULE内存宽度：72
功能数量：1端口数量：1
端子数量：240字数：134217728 words
字数代码：128000000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：128MX72输出特性：3-STATE
封装主体材料：UNSPECIFIED封装代码：DIMM
封装等效代码：DIMM240,40封装形状：RECTANGULAR
封装形式：MICROELECTRONIC ASSEMBLY峰值回流温度（摄氏度）：235
电源：1.8 V认证状态：Not Qualified
刷新周期：8192自我刷新：YES
子类别：DRAMs最大供电电压 (Vsup)：1.9 V
最小供电电压 (Vsup)：1.7 V标称供电电压 (Vsup)：1.8 V
表面贴装：NO技术：CMOS
温度等级：COMMERCIAL端子形式：NO LEAD
端子节距：1 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30Base Number Matches：1

EBE10RD4ABFA-4A 数据手册

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EBE10RD4ABFA  
Electrical Specifications  
• All voltages are referenced to VSS (GND).  
Absolute Maximum Ratings  
Parameter  
Symbol  
VT  
Value  
Unit  
Note  
Voltage on any pin relative to VSS  
Supply voltage relative to VSS  
Short circuit output current  
Power dissipation  
–0.5 to +2.3  
–0.5 to +2.3  
50  
V
VDD  
IOS  
PD  
V
mA  
W
°C  
°C  
18  
Operating case temperature  
Storage temperature  
TC  
0 to +85  
–55 to +100  
1
Tstg  
Note: 1. DDR2 SDRAM component specification.  
Caution  
Exposing the device to stress above those listed in Absolute Maximum Ratings could cause  
permanent damage. The device is not meant to be operated under conditions outside the limits  
described in the operational section of this specification. Exposure to Absolute Maximum Rating  
conditions for extended periods may affect device reliability.  
DC Operating Conditions (TC = 0 to +85°C) (DDR2 SDRAM Component Specification)  
Parameter  
Symbol  
VDD, VDDQ  
VSS  
min.  
typ.  
1.8  
0
max.  
1.9  
0
Unit  
V
Notes  
4
Supply voltage  
1.7  
0
V
VDDSPD  
VREF  
1.7  
—
3.6  
V
Input reference voltage  
Termination voltage  
DC input logic high  
DC input low  
0.49 × VDDQ  
VREF − 0.04  
VREF + 0.125  
−0.3  
0.50 × VDDQ 0.51 × VDDQ  
V
1, 2  
3
VTT  
VREF  
VREF + 0.04  
VDDQ + 0.3V  
VREF – 0.125  
V
VIH (DC)  
VIL (DC)  
VIH (AC)  
VIL (AC)  
V
V
AC input logic high  
AC input low  
VREF + 0.250  
V
VREF − 0.250  
V
Notes: 1. The value of VREF may be selected by the user to provide optimum noise margin in the system. Typically  
the value of VREF is expected to be about 0.5 × VDDQ of the transmitting device and VREF are expected  
to track variations in VDDQ.  
2. Peak to peak AC noise on VREF may not exceed ±2% VREF (DC).  
3. VTT of transmitting device must track VREF of receiving device.  
4. VDDQ must be equal to VDD.  
Preliminary Data Sheet E0366E50 (Ver. 5.0)  
10  
1...78910111213...22

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