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DP83620SQE PDF预览

DP83620SQE

更新时间： 2024-02-27 01:15:36
品牌 Logo 应用领域
德州仪器 - TI 以太网局域网（LAN）标准
页数 文件大小 规格书
105页 1160K
描述
DP83620 Industrial Temperature Single Port 10/100 Mbps Ethernet Physical Layer

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DP83620SQE 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active包装说明：HVQCCN, LCC48,.27SQ,20
Reach Compliance Code：compliantECCN代码：5A991.B.1
HTS代码：8542.39.00.01Factory Lead Time：8 weeks
风险等级：1.27Is Samacsys：N
数据速率：100000 MbpsJESD-30 代码：S-PQCC-N48
JESD-609代码：e3长度：7 mm
湿度敏感等级：2功能数量：1
端子数量：48收发器数量：1
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装等效代码：LCC48,.27SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：2.5/3.3,3.3 V认证状态：Not Qualified
座面最大高度：0.8 mm子类别：Network Interfaces
标称供电电压：3.3 V表面贴装：YES
技术：CMOS电信集成电路类型：ETHERNET TRANSCEIVER
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mmBase Number Matches：1

DP83620SQE 数据手册

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DP83620  
www.ti.com  
SNLS339C –JANUARY 2011–REVISED APRIL 2013  
10.5 PHY STATUS FRAME CONFIGURATION REGISTER - PAGE 5  
The Page 5 PHY Status Frame Configuration Register is accessible by setting bits [2:0] = 101 of  
PAGESEL (13h).  
10.5.1 PHY Status Frame Configuration Register(PSF_CFG), Page 5  
This register provides configuration for the PHY Status Frame function.  
Table 10-39. PHY Status Frame Configuration Register(PSF_CFG), address 0x18  
Bit  
Bit Name  
RESERVED  
Default  
000, RO  
00, RW  
Description  
Reserved: Writes ignored, Read as 0  
15:13  
12:11  
MAC_SRC_ADD  
PHY Status Frame Mac Source Address:  
Selects source address as follows:  
00 : Use Mac Address [08 00 17 0B 6B 0F]  
01 : Use Mac Address [08 00 17 00 00 00]  
10 : Use Mac Multicast Dest Address  
11 : Use Mac Address [00 00 00 00 00 00]  
10:8  
7
MIN_PRE  
PSF_ENDIAN  
PSF_IPV4  
000, RW  
0, RW  
PHY Status Frame Minimum Preamble:  
Determines the minimum preamble bytes required for sending packets on the MII  
interface. It is recommended that this be set to the smallest value the MAC will  
tolerate.  
PHY Status Frame Endian Control:  
For each 16-bit field in a Status Message, the data will normally be presented in  
network byte order (Most significant byte first). If this bit is set to a 1, the byte data  
fields will be reversed so that the least significant byte is first.  
6
0, RW  
PHY Status Frame IPv4 Enable:  
This bit controls the type of packet used for PHY Status Frames.  
0 = Layer2 Ethernet packets  
1 = IPv4 packets.  
5
4
PSF_PCF_RD  
PSF_ERR_EN  
0, RW  
0, RW  
PHY Control Frame Read PHY Status Frame Enable:  
Enable PHY Status Frame delivery of PHY Control Frame read data. Data read via  
a PHY Control Frame will be returned in a PHY Status Frame.  
PSF Error PHY Status Frame Enable:  
Enable PHY Status Frame delivery of PHY Status Frame Errors. This bit will not  
independently enable PHY Status Frame operation. One of the other enable bits  
must be set for PHY Status Frames to be generated.  
3:0  
RESERVED  
0000, RW  
Reserved: Must be 0x0.  
Copyright © 2011–2013, Texas Instruments Incorporated  
Register Block  
99  
Submit Documentation Feedback  
Product Folder Links: DP83620  
 
1...96979899100101102...105

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型号 品牌 描述 获取价格 数据表
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