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DAC61401

更新时间： 2024-04-09 18:59:35

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德州仪器 - TI		/
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49页	3362K
描述
Single-channel 12-bit high-voltage-output DAC with precision internal reference

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DAC61401 数据手册

DAC61401, DAC81401

ZHCSU04 –NOVEMBER 2023

www.ti.com.cn

5.5 电气特性（续）

所有最小值和最大值的条件为T_A= –40°C 至+125°C；除非另有说明，否则所有典型值的条件为T_A= 25°C、A_VDD= 4.5V 至

41.5V、A_VSS=–21.5V 至0V、V_DD= 5.0V、V_REFIO= 2.5V（外部基准）、IOV_DD= 1.7V、V_SENSEN= 0V、DAC 输出为空

载、CCOMP 未连接，且数字输入处于IOV_DD或GND

参数

测试条件

最小值典型值最大值

单位

数字输入与输出

0.7 ×

IOV_DD

V_IH

SDIN，高电平输入电压

SDIN，低电平输入电压

0.3 ×

IOV_DD

V_IL

±2

µA

输入电流

输入引脚电容

IOV_DD

–0.2

V_OH

V_OL

SDO，高电平输出电压

SDO 负载电流= 0.2mA

0.4

SDO，低电平输出电压

FAULT，低电平输出电压

输出引脚电容

SDO 负载电流= 0.2mA

FAULT 负载电流= 10mA

0.4

电源要求⁽⁵⁾

I_AVDD

1.6

µA

正常模式，内部基准或外部基准

省电模式

AV_DD电源电流⁽⁵⁾

V_DD电源电流⁽⁵⁾

AV_SS电源电流⁽⁵⁾

IOV_DD电源电流⁽⁵⁾

I_VDD

2.5

µA

数字接口静态，内部基准或外部基准

正常模式，内部基准或外部基准

-1.6

I_AVSS

–10

省电模式

I_IOVDD

120

µA

SCLK 以1MHz 频率切换

(1) 代码之间的端点拟合。16 位：A_VDD≥5.5V 时为512 至65024，A_VDD≤5.5V 时为512 至63488，V_REFIO和A_VDD之间的余度为

0.2V；12 位：A_VDD≥5.5V 时为32 至4064，A_VDD≤5.5V 时为32 至3968，V_REFIO与A_VDD之间的余度为0.2V。

(2)

_VDD≥5.5V 时写入DAC 的满量程代码。16 位：A_VDD≤5.5V 时写入DAC 的代码63488；12 位：A_VDD≤5.5V 时写入DAC 的代码

3968。

(3) 临时过载条件保护。电流限制期间可能会超过结温。在高于指定最大结温的条件下运行可能会影响器件可靠性。

(4) 根据设计和特征确定；未经生产测试。

(5) 退出省电模式以恢复正常运行的时间。从SYNC 的最后一个上升沿到DAC 最终值的90% 测得。

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English Data Sheet: SLASEH4

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