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CYD36S72V18-133BGXC

更新时间: 2024-02-18 13:23:24
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟静态存储器内存集成电路
页数 文件大小 规格书
52页 1093K
描述
Dual-Port SRAM, 512KX72, 13ns, CMOS, PBGA484, 27 X 27 MM, 2.33 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-484

CYD36S72V18-133BGXC 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Active零件包装代码:BGA
包装说明:BGA, BGA484,22X22,40针数:484
Reach Compliance Code:compliantECCN代码:3A991.B.2.A
HTS代码:8542.32.00.41风险等级:5.55
最长访问时间:13 ns其他特性:PIPELINED OR FLOW-THROUGH ARCHITECTURE, IT CAN ALSO OPERATES AT 1.8V
最大时钟频率 (fCLK):133 MHzI/O 类型:COMMON
JESD-30 代码:S-PBGA-B484JESD-609代码:e1
长度:27 mm内存密度:37748736 bit
内存集成电路类型:DUAL-PORT SRAM内存宽度:72
湿度敏感等级:3功能数量:1
端口数量:2端子数量:484
字数:524288 words字数代码:512000
工作模式:SYNCHRONOUS最高工作温度:70 °C
最低工作温度:组织:512KX72
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:BGA封装等效代码:BGA484,22X22,40
封装形状:SQUARE封装形式:GRID ARRAY
并行/串行:PARALLEL峰值回流温度(摄氏度):260
电源:1.5/1.8 V认证状态:Not Qualified
座面最大高度:2.46 mm最大待机电流:0.59 A
最小待机电流:1.4 V子类别:SRAMs
最大压摆率:1.43 mA最大供电电压 (Vsup):1.58 V
最小供电电压 (Vsup):1.42 V标称供电电压 (Vsup):1.5 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:Tin/Silver/Copper (Sn/Ag/Cu)
端子形式:BALL端子节距:1 mm
端子位置:BOTTOM处于峰值回流温度下的最长时间:20
宽度:27 mmBase Number Matches:1

CYD36S72V18-133BGXC 数据手册

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FullFlex  
Figure 4. FullFlex36 SDR 256-Ball BGA (Top View)  
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DQ32L  
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DQ28L  
DQ26L  
DQ24L  
DQ22L  
DQ20L  
DQ18L  
DQ18R  
DQ20R  
DQ22R  
DQ24R  
DQ26R  
DQ28R  
DQ30R  
DQ32R  
A
B
C
D
E
F
DQ33L  
DQ34L  
A0L  
DQ31L  
DQ35L  
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DQ29L  
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WRPL  
CE0L  
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BUSYL  
CL  
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DQ23L  
CQ1L  
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DNU  
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TRST  
VTTL  
VCORE  
VSS  
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VCORE  
VSS  
DQ21R  
DQ23R  
CQ1R  
DQ25R  
CQ1R  
DQ27R  
INTR  
DQ29R  
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WRPR  
CE0R  
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CR  
DQ31R  
DQ35R  
A1R  
DQ33R  
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[4]  
ZQ0R  
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FTSELL LOWSPDL  
VSS  
VSS  
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R
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VDDIOR VDDIOR VDDIOR  
A3R  
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A5L  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VSS  
VDDIOR  
VDDIOR  
VCORE  
A5R  
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[4]  
A6L  
A7L  
ZQ0L  
VSS  
VSS  
VSS  
VSS  
A7R  
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G
H
J
A8L  
A9L  
VCORE  
VSS  
VSS  
VSS  
VSS  
A9R  
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A10L  
A12L  
A14L  
A11L  
A13L  
A15L  
VSS  
PORTSTD VCORE  
1L  
VSS  
VSS  
VSS  
VSS  
VCORE PORTSTD  
1R  
VSS  
A11R  
A13R  
A15R  
A10R  
A12R  
A14R  
OEL  
BE1L  
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VDDIOL  
VDDIOL  
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VSS  
VSS  
VSS  
VSS  
VDDIOR  
VDDIOR  
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BE0R  
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K
L
ADSL  
R/WL  
VSS  
VSS  
VSS  
VSS  
ADSR  
R/WR  
[13]  
[12]  
[12]  
[13]  
A16L  
A17L  
CQENL  
VDDIOL  
VDDIOL  
DNU  
VCORE  
VTTL  
TMS  
VCORE  
VTTL  
TDO  
VDDIOR VDDIOR VDDIOR  
CQENR  
A17R  
A16R  
M
N
P
R
T
[11]  
[11]  
A18L  
DNU  
CNT/MSK VREFL PORTSTD READYL  
DNU  
TDI  
READYR PORTSTD VREFR CNT/MSK  
DNU  
A18R  
L
0L  
0R  
R
DQ16L  
DQ15L  
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DQ17L  
DQ13L  
DQ12L  
CNTENL CNTRSTL  
CQ0L  
CQ0L  
DQ5L  
DQ4L  
TCK  
CQ0R  
DQ5R  
DQ4R  
CQ0R  
CNTRSTR CNTENR  
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DQ1L  
DQ0L  
DQ1R  
DQ0R  
DQ3R  
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DQ7R  
DQ6R  
DQ9R  
DQ8R  
DQ11R  
DQ10R  
Notes  
11. Leave this ball unconnected for CYD09S36V18, CYD04S36V18, and CYD02S36V18.  
12. Leave this ball unconnected for CYD04S36V18 and CYD02S36V18.  
13. Leave this ball unconnected for CYD02S36V18.  
Document Number: 38-06082 Rev. *H  
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