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CY7C1360A

更新时间： 2022-04-23 23:00:11

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赛普拉斯 - CYPRESS		静态存储器
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28页	559K
描述
256K x 36/512K x 18 Synchronous Pipelined Burst SRAM

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CY7C1360A 数据手册

CY7C1360A

CY7C1362A

Functional Block Diagram—256K × 36^[1]

BYTE a WRITE

BWa

BWE

CLK

BYTE b WRITE

BWb

BYTE c WRITE

BWc

BYTE d WRITE

BWd

ENABLE

CE2

ZZZZ

Power Down Logic

Input

ADSP

Address

OUTPUT

ADSC

DQa,DQb

DQc,DQd

DQa, DQb,

DQc, DQd

CLR

ADV

Binary

Counter

& Logic

A0-A1

A1-A0

MODE

Functional Block Diagram—512K × 18^[1]

BYTE b

WRITE

BWb

BWE

CLK

BYTE a

WRITE

BWa

ENABLE

CE CE

CE2

Power Down Logic

ADSP

Input

Address

OUTPUT

ADSC

DQa, DQb,

DQa,DQb

CLR

ADV

Binary

Counter

& Logic

A1-A0

A0-A1

MODE

Notes:

1. The Functional Block Diagram illustrates simplified device operation. See Truth Table, pin descriptions, and timing diagrams for detailed information.

2. CE₃is for TA version only.

Document #: 38-05258 Rev. *A

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型号	品牌	描述	获取价格	数据表
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