CY7B9910-2SCT

更新时间： 2024-02-27 15:31:35

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		时钟
页数	文件大小	规格书
11页	373K
描述
Low Skew Clock Buffer

阅读下载

获取价格

技术参数
数据手册

如果您发现信息不准确，欢迎纠错

CY7B9910-2SCT 技术参数

生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	24
Reach Compliance Code：	unknown	风险等级：	5.66
Is Samacsys：	N	系列：	7B
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G24
长度：	15.392 mm	逻辑集成电路类型：	CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	24	实输出次数：	8
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
传播延迟（tpd）：	0.25 ns	认证状态：	COMMERCIAL
Same Edge Skew-Max（tskwd）：	0.25 ns	座面最大高度：	2.667 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	BICMOS	温度等级：	COMMERCIAL
端子面层：	NOT SPECIFIED	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	7.5057 mm	最小 fmax：	80 MHz
Base Number Matches：	1

CY7B9910-2SCT 数据手册

CY7B9910

CY7B9920

Low Skew Clock Buffer

The completely integrated PLL enables “zero delay” capability.

External divide capability, combined with the internal PLL, allows

distribution of a low frequency clock that is multiplied by virtually

any factor at the clock destination. This facility minimizes clock

distribution difficulty while allowing maximum system clock

speed and flexibility.

Features

■ All outputs skew <100 ps typical (250 max.)

■ 15 to 80 MHz output operation

■ Zero input to output delay

■ 50% duty cycle outputs

Block Diagram Description

■ Outputs drive 50Ω terminated lines

■ Low operating current

Phase Frequency Detector and Filter

The Phase Frequency Detector and Filter blocks accept inputs

from the reference frequency (REF) input and the feedback (FB)

input and generate correction information to control the

frequency of the Voltage Controlled Oscillator (VCO). These

blocks, along with the VCO, form a Phase Locked Loop (PLL)

that tracks the incoming REF signal.

■ 24-pin SOIC package

■ Jitter:<200 ps peak to peak, <25 ps RMS

Functional Description

The CY7B9910 and CY7B9920 Low Skew Clock Buffers offer

low skew system clock distribution. These multiple output clock

drivers optimize the timing of high performance computer

systems. Each of the eight individual drivers can drive terminated

transmission lines with impedances as low as 50Ω. They deliver

minimal and specified output skews and full swing logic levels

(CY7B9910 TTL or CY7B9920 CMOS).

VCO

The VCO accepts analog control inputs from the PLL filter block

and generates a frequency. The operational range of the VCO is

determined by the FS control pin.

Logic Block Diagram

TEST

VOLTAGE

PHASE

FREQ

DET

FILTER

CONTROLLED

OSCILLATOR

REF

Cypress Semiconductor Corporation

Document Number: 38-07135 Rev. *B

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised August 07, 2007

[+] Feedback

12 3 4 5 6 7...11

下载PDF

与CY7B9910-2SCT相关器件

型号	品牌	描述	获取价格	数据表
CY7B9910-2SXC	CYPRESS	Low Skew Clock Buffer	获取价格
CY7B9910-2SXC	ROCHESTER	7B SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24, 0.300 I	获取价格
CY7B9910-2SXCT	CYPRESS	Low Skew Clock Buffer	获取价格
CY7B9910-2SXCT	ROCHESTER	7B SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24, 0.300 I	获取价格
CY7B9910-5SC	CYPRESS	Low Skew Clock Buffer	获取价格
CY7B9910-5SCT	CYPRESS	Low Skew Clock Buffer	获取价格

与CY7B9910-2SCT相关文章

NE5532双低噪声运算放大器：资料手册参数分析
2024-05-07

6
74LS138 3-to-8线解码器/多路复用器：资料手册参数分析
2024-05-07

17
TDA2030音频功率放大器：资料手册参数分析
2024-05-07

36
74HC595移位寄存器芯片：参数深入解析与应用实践指南
2024-05-07

25

产品中心

服务支持

精选活动

关于我们

帮助中心

CY7B9910-2SCT

CY7B9910-2SCT 技术参数

CY7B9910-2SCT 数据手册

与CY7B9910-2SCT相关器件

与CY7B9910-2SCT相关文章

您还可以找

产品中心

服务支持

精选活动

关于我们

帮助中心

CY7B9910-2SCT

CY7B9910-2SCT 技术参数

CY7B9910-2SCT 数据手册

与CY7B9910-2SCT相关器件

与CY7B9910-2SCT相关文章

您还可以找

您在本页遇到什么问题？