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CY28353OXC-2T

更新时间： 2024-02-20 12:32:46

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赛普拉斯 - CYPRESS		光电二极管
页数	文件大小	规格书
10页	209K
描述
Clock Driver, PDSO28,

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CY28353OXC-2T 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	SSOP, SSOP28,.3	Reach Compliance Code：	compliant
风险等级：	5.81	JESD-30 代码：	R-PDSO-G28
JESD-609代码：	e3	最大I（ol）：	0.012 A
湿度敏感等级：	3	端子数量：	28
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装等效代码：	SSOP28,.3	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	电源：	2.5 V
Prop。Delay @ Nom-Sup：	6 ns	认证状态：	Not Qualified
子类别：	Clock Drivers	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
Base Number Matches：	1

CY28353OXC-2T 数据手册

CY28353-2

Differential Clock Buffer/Driver

Features

Description

• Phase-locked loop (PLL) clock distribution for double

This PLL clock buffer is designed for 2.5 V_DDand 2.5 AV_DD

data rate synchronous DRAM applications

operation and differential data input and output levels.

• Distributesonedifferentialclockinputtosixdifferential

outputs

This device is a zero delay buffer that distributes a differential

clock input pair (CLKINT, CLKINC) to six differential pairs of

clock outputs (CLKT[0:5], CLKC[0:5]) and one differential pair

feedback clock outputs (FBOUTT, FBOUTC). The clock

outputs are controlled by the input clocks (CLKINT, CLKINC)

and the feedback clocks (FBINT, FBINC).

The two-line serial bus can set each output clock pair

(CLKT[0:5], CLKC[0:5]) to the Hi-Z state. When AV_DDis

grounded, the PLL is turned off and bypassed for test

purposes.

• External feedback pins (FBINT, FBINC) are used to

synchronize the outputs to the clock input

• Conforms to the DDRI specification

• Spread Aware for electromagnetic interference (EMI)

reduction

• 28-pin SSOP package

The PLL in this device uses the input clocks (CLKINT,

CLKINC) and the feedback clocks (FBINT, FBINC) to provide

high-performance, low-skew, low–jitter output differential

clocks.

Block Diagram

Pin Configuration

CLKC0

CLKT0

VDD

CLKT1

CLKC1

GND

CLKT0

CLKC5

CLKT5

CLKC4

CLKT4

VDD

CLKC0

CLKT1

CLKC1

CLKT2

CLKC2

Serial

Interface

Logic

SCLK

SDATA

FBINC

SCLK

CLKT3

CLKC3

CLKINT

CLKINC

AVDD

AGND

VDD

FBINT

FBOUTT

FBOUTC

CLKT3

CLKC3

GND

CLKT4

CLKC4

CLKINT

CLKINC

PLL

CLKT5

CLKC5

FBINC

FBINT

CLKT2

CLKC2

FBOUTT

FBOUTC

AVDD

28 pin SSOP

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Document #: 38-07372 Rev. *B

Revised August 30, 2004

12 3 4 5 6 7...10

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型号	品牌	获取价格	描述	数据表
CY28354-400	CYPRESS	获取价格	210-MHz 24-Output Buffer for 4-DDR DIMMS for VIA Chipsets Support
CY28354-400	SPECTRALINEAR	获取价格	210 MHz 24 Output Buffer for 4-DDR DIMMS for VIA Chipsets Support
CY28354OC-400	CYPRESS	获取价格	Low Skew Clock Driver, 12 True Output(s), 12 Inverted Output(s), PDSO48, LEAD FREE, SSOP-4
CY28354OXC-400	SPECTRALINEAR	获取价格	210 MHz 24 Output Buffer for 4-DDR DIMMS for VIA Chipsets Support
CY28354OXC-400	CYPRESS	获取价格	210-MHz 24-Output Buffer for 4-DDR DIMMS for VIA Chipsets Support
CY28354OXC-400T	SPECTRALINEAR	获取价格	210 MHz 24 Output Buffer for 4-DDR DIMMS for VIA Chipsets Support
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CY28358	CYPRESS	获取价格	200-MHz Differential Clock Buffer/Driver
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CY28358OC	SPECTRALINEAR	获取价格	200-MHz Differential Clock Buffer/Driver

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