CXD2467Q

更新时间： 2024-02-04 10:08:47

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索尼 - SONY		驱动器消费电路商用集成电路
页数	文件大小	规格书
38页	532K
描述
Digital Signal Driver/Timing Generator

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CXD2467Q 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	FQFP,	针数：	240
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.84	Is Samacsys：	N
商用集成电路类型：	CONSUMER CIRCUIT	JESD-30 代码：	S-PQFP-G240
长度：	32 mm	功能数量：	1
端子数量：	240	最高工作温度：	75 °C
最低工作温度：	-20 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	FQFP	封装形状：	SQUARE
封装形式：	FLATPACK, FINE PITCH	认证状态：	Not Qualified
座面最大高度：	4.1 mm	最大压摆率：	490 mA
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL EXTENDED	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	32 mm	Base Number Matches：	1

CXD2467Q 数据手册

CXD2467Q

Input pin

processing

for open status

No.

Symbol

I/O

Description

CLKOUT

Vss

—

1/2 frequency-divided clock output

GND

—

CLKSEL1

CLKSEL2

Input clock selection (High: CLK1C, Low: CLK1P, N)

Input clock selection (High: CLK2, Low: CLK1)

1/2 frequency division circuit output selection

(High: XQ output, Low: Q output)

CLKPOL1

HDIN2

—

Horizontal sync signal input-2

HDIN2 input polarity selection

(High: positive polarity, Low: negative polarity)

HDPOL2

CLK3P

CLK3N

VDD

Clock input-2 (small-amplitude differential input, positive polarity)

Clock input-2 (small-amplitude differential input, negative polarity)

Power supply

—

VSS

GND

CLK3C

VSS

Clock input-2 (CMOS input)

—

GND

CLK4

1/2 frequency-divided clock input-2 (CMOS input)

Input clock selection (High: CLK3C, Low: CLK3P, N)

Input clock selection (High: CLK4, Low: CLK3)

CLKSEL3

CLKSEL4

1/2 frequency division circuit output selection

(High: XQ output, Low: Q output)

CLKPOL2

IRRET

HRET

—

Auxiliary pulse output

GND

—

VSS

XCLR

External clear (Low: reset)

Power supply

VDD

—

VSS

GND

B2OUT0

B2OUT1

B2OUT2

B2OUT3

B2OUT4

B2OUT5

B2OUT6

B2OUT7

B2OUT8

B2OUT9

Blue data output (port 2)

– 5 –

1 2 3 456 7 8...38

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