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ATA5429-PLQW PDF预览

ATA5429-PLQW

更新时间： 2024-02-03 07:01:03
品牌 Logo 应用领域
爱特美尔 - ATMEL 电信集成电路电信电路
页数 文件大小 规格书
100页 1501K
描述
UHF ASK/FSK Transceiver

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ATA5429-PLQW 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFN
包装说明：HVQCCN,针数：48
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.83Is Samacsys：N
JESD-30 代码：S-XQCC-N48JESD-609代码：e3
长度：7 mm功能数量：1
端子数量：48最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1 mm
标称供电电压：3 V表面贴装：YES
电信集成电路类型：TELECOM CIRCUIT温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：7 mm
Base Number Matches：1

ATA5429-PLQW 数据手册

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ATA5423/ATA5425/ATA5428/ATA5429  
17. Digital Port Characteristics  
All parameters refer to GND and are valid for Tamb = –40°C to +85 °C, VVS1 = VS2 = 2.4V to 3.6V (1 Li battery application (3V)) and  
VVS2 = 4.4V to 6.6 V (2 Li battery application (6V)) and VVS2 = 4.75V to 5.25V (Base-station Application (5V)). Typical values at  
VVS1 = VVS2 = 3V and Tamb = 25°C unless otherwise specified.  
No. Parameters  
Test Conditions  
Pin  
Symbol  
Min.  
Typ.  
Max.  
Unit  
Type*  
17  
Digital Ports  
CS input  
Low level input voltage  
0.2 ×  
VVSINT  
VVSINT = 2.4V to 5.25V  
35  
35  
33  
33  
32  
32  
VIl  
VIh  
VIl  
V
V
V
V
V
V
A
A
A
A
A
A
17.1  
0.8 ×  
VVSINT  
High level input voltage VVSINT = 2.4V to 5.25V  
VVSINT  
SCK input  
0.2 ×  
VVSINT  
VVSINT = 2.4V to 5.25V  
Low level input voltage  
17.2  
17.3  
0.8 ×  
VVSINT  
High level input voltage VVSINT = 2.4V to 5.25V  
VIh  
VIl  
VVSINT  
SDI_TMDI input  
0.2 ×  
VVSINT  
VVSINT = 2.4V to 5.25V  
Low level input voltage  
0.8 ×  
VVSINT  
High level input voltage VVSINT = 2.4V to 5.25V  
VIh  
VVSINT  
TEST1 input must  
17.4 TEST1 input  
17.5 TEST2 input  
PWR_ON input  
always be directly  
connected to GND  
20  
23  
0
0
0
V
V
TEST2 input must  
always be direct  
connected to GND  
0
Internal pull-down with  
series connection of  
40  
40  
VIl  
0.4  
V
A
Low level input voltage 40 kΩ ±20% resistor  
and diode  
17.6  
Internal pull-down with  
High level input  
voltage(1)  
series connection of  
40 kΩ ±20% resistor  
and diode  
0.8  
× VVS2  
VIh  
VIl  
V
V
A
A
41, 42,  
43, 44,  
45  
Tn input  
Internal pull-up resistor  
0.2  
× VVS2  
Low level input voltage of 50 kΩ ±20%  
17.7  
17.8  
41, 42,  
43, 44,  
45  
High level input  
voltage(1)  
Internal pull-up resistor  
of 50 kΩ ±20%  
× VVS2  
–0.5V  
VIh  
VIl  
V
V
A
A
433_N868 input  
Low level input voltage  
6
0.25  
Input current low  
6
6
6
IIl  
VIh  
IIh  
–5  
AVCC  
1
µA  
V
A
A
A
High level input voltage  
Input current high  
1.7  
µA  
*) Type means: A = 100% tested, B = 100% correlation tested, C = Characterized on samples, D = Design parameter  
Note:  
1. If a logic high level is applied to this pin, a minimum serial impedance of 100Ωmust be ensured for proper operation over full  
temperature range.  
95  
4841D–WIRE–10/07  
1...92939495969798...100

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