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ADT7519

更新时间： 2024-01-04 19:56:57
品牌 Logo 应用领域
亚德诺 - ADI 传感器温度传感器
页数 文件大小 规格书
44页 1144K
描述
SPI-/I2C-Compatible, Temperature Sensor,4-Channel ADC and Quad Voltage Output

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ADT7519 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete包装说明：LEAD FREE, MO-137AB, QSOP-16
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.71
最大精度（摄氏度）：1 Cel主体宽度：3.91 mm
主体高度：1.54 mm主体长度或直径：4.9 mm
外壳：PLASTICJESD-609代码：e3
安装特点：SURFACE MOUNT位数：8
端子数量：16最大工作电流：0.001 mA
最高工作温度：120 °C最低工作温度：-40 °C
输出接口类型：4-WIRE INTERFACE封装主体材料：PLASTIC/EPOXY
封装等效代码：SSOP16,.25封装形状/形式：RECTANGULAR
电源：3/5 V传感器/换能器类型：TEMPERATURE SENSOR,SWITCH/DIGITAL OUTPUT,SERIAL
子类别：Other Sensors最大供电电压：5.5 V
最小供电电压：2.7 V表面贴装：YES
技术：CMOS温度系数：NEGATIVE ppm/ °C
端子面层：Matte Tin (Sn)端接类型：SOLDER
Base Number Matches：1

ADT7519 数据手册

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ADT7516/ADT7517/ADT7519  
Parameter1  
Min  
Typ  
Max  
Unit  
Conditions/Comments  
ON-CHIP REFERENCE  
Reference Voltage4  
Temperature Coefficient4  
OUTPUT CHARACTERISTICS4  
Output Voltage6  
2.2662 2.28  
80  
2.2938  
V
ppm/°C  
0.001  
VDD − 0.1  
V
This is a measure of the minimum and maximum  
drive capability of the output amplifier  
DC Output Impedance  
Short Circuit Current  
0.5  
25  
16  
2.5  
5
Ω
mA  
mA  
μs  
VDD = 5 V  
VDD = 3 V  
Power-Up Time  
Coming out of power-down mode, VDD = 5 V  
Coming out of power-down mode, VDD = 3.3 V  
μs  
DIGITAL INPUTS4  
Input Current  
1
0.8  
μA  
V
V
pF  
ns  
VIN = 0 V to VDD  
VIL, Input Low Voltage  
VIH, Input High Voltage  
Pin Capacitance  
1.89  
3
10  
50  
All digital inputs  
Input filtering suppresses noise spikes of less  
than 50 ns  
SCL, SDA Glitch Rejection  
LDAC Pulse Width  
20  
ns  
Edge triggered input  
DIGITAL OUTPUT  
Digital High Voltage, VOH  
Output Low Voltage, VOL  
Output High Current, IOH  
Output Capacitance, COUT  
INT/INT Output Saturation Voltage  
2.4  
V
V
mA  
pF  
V
ISOURCE = ISINK = 200 μA  
IOL = 3 mA  
VOH = 5 V  
0.4  
1
50  
0.8  
I
OUT = 4 mA  
I2C TIMING CHARACTERISTICS7, 8  
Serial Clock Period, t1  
Data In Setup Time to SCL High, t2  
Data Out Stable after SCL Low, t3  
SDA Low Setup Time to SCL  
Low (Start Condition), t4  
2.5  
50  
0
μs  
ns  
ns  
ns  
Fast mode I2C, see Figure 2  
See Figure 2  
See Figure 2  
50  
SDA High Hold Time after SCL  
High (Stop Condition), t5  
50  
ns  
See Figure 2  
SDA and SCL Fall Time, t6  
SDA and SCL Rise Time, t7  
SPI TIMING CHARACTERISTICS4, 10  
CS to SCLK Setup Time, t1  
SCLK High Pulse Width, t2  
SCLK Low Pulse Width, t3  
Data Access Time after SCLK  
300  
ns  
ns  
See Figure 2  
See Figure 2  
3009  
0
ns  
ns  
ns  
ns  
See Figure 3  
See Figure 3  
See Figure 3  
50  
50  
35  
11  
Falling Edge, t4  
Data Setup Time Prior to SCLK  
Rising Edge, t5  
Data Hold Time after SCLK  
Rising Edge, t6  
20  
0
ns  
ns  
See Figure 3  
See Figure 3  
CS to SCLK Hold Time, t7  
0
μs  
ns  
See Figure 3  
See Figure 3  
CS to DOUT High Impedance, t8  
40  
POWER REQUIREMENTS  
VDD  
VDD Settling Time  
IDD (Normal Mode)12  
2.7  
5.5  
50  
3
V
ms  
mA  
mA  
VDD settles to within 10% of its final voltage level  
VDD = 3.3 V, VIH = VDD, and VIL = GND  
VDD = 5 V, VIH = VDD, and VIL = GND  
2.2  
3
Rev. B | Page 5 of 44  
12345678...44

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