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ADMCF341

更新时间: 2024-02-28 06:14:59
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亚德诺 - ADI 闪存
页数 文件大小 规格书
36页 1065K
描述
DashDSP⑩ 28-Lead Flash Mixed-Signal DSP with Enhanced Analog Front End

ADMCF341 技术参数

是否Rohs认证: 不符合生命周期:Obsolete
零件包装代码:SOIC包装说明:SOIC-28
针数:28Reach Compliance Code:not_compliant
ECCN代码:EAR99HTS代码:8542.31.00.01
风险等级:5.88Is Samacsys:N
地址总线宽度:桶式移位器:YES
边界扫描:NO最大时钟频率:10 MHz
外部数据总线宽度:格式:FIXED POINT
内部总线架构:MULTIPLEJESD-30 代码:R-PDSO-G28
JESD-609代码:e0长度:17.9 mm
低功率模式:YES端子数量:28
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:SOP
封装形状:RECTANGULAR封装形式:SMALL OUTLINE
峰值回流温度(摄氏度):220认证状态:Not Qualified
座面最大高度:2.65 mm表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:Tin/Lead (Sn/Pb)端子形式:GULL WING
端子节距:1.27 mm端子位置:DUAL
处于峰值回流温度下的最长时间:30宽度:7.5 mm
uPs/uCs/外围集成电路类型:DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches:1

ADMCF341 数据手册

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ADMCF341  
TIMING PARAMETERS  
Parameter  
Min  
Max  
Unit  
Serial Ports  
Timing Requirements  
tSCK  
tSCS  
tSCH  
tSCP  
SCLK Period  
100  
15  
20  
ns  
ns  
ns  
ns  
DR/TFS/RFS Setup before SCLK Low  
DR/TFS/RFS Hold after SCLK Low  
SCLKIN Width  
40  
Switching Characteristics  
tCC  
CLKOUT High to SCLKOUT  
0.25 tCK  
0
0.25 tCK + 20  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
tSCDE  
tSCDV  
tRH  
SCLK High to DT Enable  
SCLK High to DT Valid  
TFS/RFSOUT Hold after SCLK High  
TFS/RFSOUT Delay from SCLK High  
DT Hold after SCLK High  
SCLK High to DT Disable  
TFS (Alt) to DT Enable  
TFS (Alt) to DT Valid  
RFS (Multichannel, Frame Delay Zero) to DT Valid  
30  
30  
30  
0
0
0
tRD  
tSCDH  
tSCDD  
tTDE  
tTDV  
tRDV  
25  
30  
Specifications subject to change without notice.  
CLKOUT  
SCLK  
tCC  
tCC  
tSCK  
tSCP  
tSCS tSCH  
tSCP  
DR  
RFS  
TFS  
IN  
IN  
tRD  
tRH  
RFS  
TFS  
OUT  
OUT  
tSCDD  
tSCDV  
tSCDH  
tSCDE  
DT  
tTDE  
tTDV  
TFS  
(ALTERNATE  
FRAME MODE)  
tRDV  
RFS  
(MULTICHANNEL MODE,  
FRAME DELAY 0 [MFD = 0])  
Figure 2. Serial Port Timing  
REV. 0  
–5–  

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