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ADF4355

更新时间： 2024-02-27 01:07:06

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亚德诺 - ADI		/
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35页	848K
描述
Microwave Wideband Synthesizer with Integrated VCO

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ADF4355 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	HVQCCN,
针数：	32	Reach Compliance Code：	compliant
风险等级：	5.65	模拟集成电路 - 其他类型：	PHASE LOCKED LOOP
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
座面最大高度：	0.8 mm	最大供电电压 (Vsup)：	3.45 V
最小供电电压 (Vsup)：	3.15 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	5 mm	Base Number Matches：	1

ADF4355 数据手册

Data Sheet

ADF4355

SPECIFICATIONS

AV_DD= DV_DD= V_RF= 3.3 V 5%, 4.75 V ≤ V_P= V_VCO≤ 5.25 V, A _GND= CP_GND= A_GNDVCO= SD_GND= A_GNDRF= 0 V, R_SET= 5.1 kΩ,

dBm referred to 50 Ω, T_A= T_MINto T_MAX, unless otherwise noted.

Table 1.

Parameter

Symbol

Min

Typ

Max

Unit

Test Conditions/Comments

REF_INA/REF_INB CHARACTERISTICS

Input Frequency

For f < 10 MHz, ensure slew rate > 21V/µs

Single-Ended Mode

Differential Mode

Doubler Enabled

250

600

100

MHz

Doubler is set in Register 4, Bit DB26

Input Sensitivity

Single-Ended Mode

0.4

AV_DD

1.8

V p-p

REF_INA biased at AV_DD/2; ac coupling

ensures AV_DD/2 bias

LVDS and LVPECL compatible,

REF_INA/REF_INB biased at 2.1 V;

ac coupling ensures 2.1 V bias

Differential Mode

Input Capacitance

Single-Ended Mode

Differential Mode

Input Current

6.9

1.4

µA

MHz

250

125

Single-ended reference programmed

Differential reference programmed

Phase Detector Frequency

CHARGE PUMP (CP)

Charge Pump Current, Sink/Source

High Value

I_CP

R_SET= 5.1 kΩ

4.8

0.3

5.1

1.5

kΩ

Low Value

R_SETRange

Fixed

Current Matching

0.5 V ≤ V_CP¹≤ V_P− 0.5 V

V_CP¹= 2.5 V

I_CPvs. V_CP

I_CPvs. Temperature

LOGIC INPUTS

Input High Voltage

Input Low Voltage

Input Current

Input Capacitance

LOGIC OUTPUTS

Output High Voltage

V_INH

V_INL

I_INH/I_INL

C_IN

1.5

µA

0.6

3.0

1.8

V_OH

DV_DD− 0.4

1.5

1.8 V output selected

I_OL²= 500 µA

Output High Current

Output Low Voltage

I_OH

V_OL

500

0.4

µA

POWER SUPPLIES

Analog Power

AV_DD

3.15

4.75

3.45

Digital Power and RF Supply Voltage

Charge Pump and VCO Voltage

Charge Pump Supply Power Current

DV_DD, V_RF

V_P, V_VCO

I_P

AV_DD

5.0

Voltages must equal AV_DD

V_Pmust equal V_VCO

5.25

Digital Power Supply Current +

Analog Power Supply Curent³

DI_DD, AI_DD

Output Dividers

Supply Current

6 to 36

Each output divide by 2 consumes 6 mA

I_VCO

RF_OUTA /RF_OUT

Supply Current

16/20/ 20/35/ mA

RF output stage is programmable;

RF_OUTB+/RF_OUTB− powered off

RF_OUTx±

42/55

50/70

Low Power Sleep Mode

500

1000

µA

Hardware power-down

Software power-down

Rev. B | Page 3 of 35

1 234 5 6 7...35

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