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ADF41513_V01

更新时间： 2024-01-15 16:57:53

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亚德诺 - ADI		/
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30页	1391K
描述
26.5 GHz, Integer N/Fractional-N, PLL Synthesizer

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ADF41513_V01 数据手册

ADF41513

Data Sheet

Lock Detector Bias

Set all reserved bits to zero.

The lock detector window size is set by adjusting the lock

detector bias in conjunction with the lock detector precision

bits (Register 6, Bits[9:8]). See the Lock Detector section.

RESERVED REGISTER (R8)

RESERVED

CONTROL

BITS

DB31 DB30 DB29 DB28 DB27 DB26 DB25 DB24 DB23 DB22 DB21 DB20 DB19 DB18 DB17 DB16 DB15 DB14 DB13 DB12 DB11 DB10 DB9 DB8 DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0

C4(1) C3(0) C2(0) C1(0)

Figure 31. Register 8 (R8) Map

LOCK DETECTOR BIAS REGISTER (R9)

CONTROL

BITS

RESERVED

DB31 DB30 DB29 DB28 DB27 DB26 DB25 DB24 DB23 DB22 DB21 DB20 DB19 DB18 DB17 DB16 DB15 DB14 DB13 DB12 DB11 DB10 DB9 DB8 DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0

C4(1) C3(0) C2(0) C1(1)

LB2 LB1

LB2 LB1 LOCK DETECTOR BIAS

40µA

30µA

20µA

10µA

Figure 32. Register 9 (R9) Map

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