Datasheet > 信号电路 > 锁相环或频率合成电路> ADF4107BRU-REEL7

ADF4107BRU-REEL7

更新时间： 2024-02-08 23:35:42

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亚德诺 - ADI		光电二极管信息通信管理
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PLL Frequency Synthesizer

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ADF4107BRU-REEL7 技术参数

Source Url Status Check Date：	2013-05-01 14:56:35.524	是否无铅：	含铅
是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	MO-153AB, TSSOP-16
针数：	16	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.4	Is Samacsys：	N
模拟集成电路 - 其他类型：	PLL FREQUENCY SYNTHESIZER	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e0	长度：	5 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	240	电源：	3/3.3 V
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	PLL or Frequency Synthesis Circuits	最大供电电压 (Vsup)：	3.3 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	3 V
表面贴装：	YES	技术：	BICMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	20
宽度：	4.4 mm	Base Number Matches：	1

ADF4107BRU-REEL7 数据手册

ADF4107

Parameter

B Chips²Unit

(Typ)

Test Conditions/Comments

Version¹

NOISE CHARACTERISTICS

ADF4107 Phase Noise Floor⁹

–174

–166

–159

–174

–166

–159

dBc/Hz typ

@ 25 kHz PFD Frequency

@ 200 kHz PFD Frequency

@ 1 MHz PFD Frequency

Phase Noise Performance¹⁰

900 MHz Output¹¹

6400 MHz Output¹²

6400 MHz Output¹³

Spurious Signals

@ VCO Output

–93

–76

–83

–93

–76

–83

dBc/Hz typ

@ 1 kHz offset and 200 kHz PFD Frequency

@ 1 kHz offset and 1 MHz PFD Frequency

900 MHz Output¹¹

6400 MHz Output¹²

6400 MHz Output¹³

–90/–92

–65/–70

–70/–75

–90/–92

–65/–70

–70/–75

dBc typ

@ 200 kHz/400kHz and 200 kHz PFD Frequency

@ 1 MHz/2MHz and 1 MHz PFD Frequency

¹Operating temperature range (B Version) is –40°C to +85°C.

²The B Chip specifications are given as typical values.

³Use a square wave for lower frequencies, below the minimum stated.

⁴This is the maximum operating frequency of the CMOS counters. The prescaler value should be chosen to ensure that the RF input is divided down to a frequency that

is less than this value.

⁵AV_DD= DV_DD= 3 V.

⁶Guaranteed by design. Sample tested to ensure compliance.

⁷T_A= 25°C; AV_DD= DV_DD= 3 V; P = 32; RF_IN= 7.0 GHz.

⁸T_A= 25°C; AV_DD= DV_DD= 3.3 V; R = 16383; A = 63; B = 891; P = 32; RF_IN= 7.0 GHz.

⁹The synthesizer phase noise floor is estimated by measuring the in-band phase noise at the output of the VCO and subtracting 20logN (where N is the N divider value).

¹⁰The phase noise is measured with the EVAL-ADF4107EB1 Evaluation Board and the HP8562E Spectrum Analyzer. The spectrum analyzer provides the REFIN for the

synthesizer (f_REFOUT= 10 MHz @ 0 dBm).

= 10 MHz; f_PFD= 200 kHz; Offset Frequency = 1 kHz; f_RF= 900 MHz; N = 4500; Loop B/W = 20 kHz.

= 10 MHz; f_PFD= 200 kHz; Offset Frequency = 1 kHz; f_RF= 6400 MHz; N = 32000; Loop B/W = 20 kHz.

= 10 MHz; f_PFD= 1 MHz; Offset Frequency = 1 kHz; f_RF= 6400 MHz; N = 6400; Loop B/W = 100 kHz.

REFIN

Rev. 0 | Page 4 of 20

1 2 345 6 7...20

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