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ADAU1462WBCPZ150

更新时间： 2024-01-25 21:22:49

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亚德诺 - ADI		商用集成电路
页数	文件大小	规格书
202页	10165K
描述
SigmaDSP Digital Audio Processor

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ADAU1462WBCPZ150 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	HVQCCN,
针数：	72	Reach Compliance Code：	compliant
风险等级：	5.58	商用集成电路类型：	CONSUMER CIRCUIT
JESD-30 代码：	S-XQCC-N72	长度：	10 mm
湿度敏感等级：	3	功能数量：	1
端子数量：	72	最高工作温度：	105 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
座面最大高度：	1 mm	最大供电电压 (Vsup)：	1.26 V
最小供电电压 (Vsup)：	1.14 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	10 mm
Base Number Matches：	1

ADAU1462WBCPZ150 数据手册

Data Sheet

ADAU1462/ADAU1466

REVISION HISTORY

3/2018—Rev. B to Rev. C

Changes to Table 6 ............................................................................9

Changes to Table 21 ........................................................................29

Changes to PLL Filter Section and Table 22................................30

Changes to Clock Generators Section and Figure 18.................31

Changes to Figure 19 ......................................................................32

Changes to Figure 26 ......................................................................37

Changes to Figure 27 ......................................................................38

Changes to SigmaDSP Core Section ............................................80

Changes to Table 58 ........................................................................89

Changes to Figure 82 ......................................................................90

Changes to Figure 83 ......................................................................91

Changes to Ordering Guide.........................................................202

Changes to Table 1 ............................................................................4

Changes to Table 2 ............................................................................5

Changes to Table 3 ............................................................................6

Added Endnote 1, Table 6 ................................................................9

Deleted Endnote 1, Table 9 ............................................................11

Changes to S/PDIF Transmitter and Receiver Section and

Table 10.............................................................................................11

Deleted S/PDIF Receiver Section and Table 11; Renumbered

Sequentially......................................................................................11

Added Table 11; Renumbered Sequentially.................................12

Added I²C Interface—Master Section ..........................................13

Changes to Table 20 ........................................................................29

Changes to Table 21 ........................................................................30

Changes to SigmaDSP Core Section.............................................80

Changes to Ordering Guide.........................................................202

9/2017—Rev. 0 to Rev. A

Change to Supply Current Analog Current (AVDD) Parameter,

Table 2.................................................................................................4

Change to Supply Current PLL Current (PVDD) Parameter and

Supply Current Analog Current (AVDD) Parameter, Table 3 ....5

Added Endnote 2 to Ordering Guide.........................................201

10/2017—Rev. A to Rev. B

Changes to Table 1 ............................................................................4

Changes to Table 2 ............................................................................5

Changes to Table 3 ............................................................................6

8/2017—Revision 0: Initial Version

Rev. C | Page 3 of 202

1 234 5 6 7...202

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